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MC10117LD

更新时间： 2024-11-09 13:11:15

品牌	Logo	应用领域
摩托罗拉 - MOTOROLA		栅
页数	文件大小	规格书
5页	108K
描述
OR-AND/OR-AND-Invert Gate, ECL10K, CDIP16

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MC10117LD 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
Reach Compliance Code：	unknown	风险等级：	5.89
JESD-30 代码：	R-XDIP-T16	JESD-609代码：	e0
逻辑集成电路类型：	OR-AND/OR-AND-INVERT GATE	端子数量：	16
最高工作温度：	85 °C	最低工作温度：	-30 °C
封装主体材料：	CERAMIC	封装代码：	DIP
封装等效代码：	DIP16,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	电源：	-5.2 V
施密特触发器：	NO	子类别：	Gates
表面贴装：	NO	技术：	ECL10K
温度等级：	OTHER	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	Base Number Matches：	1

MC10117LD 数据手册

SEMICONDUCTOR TECHNICAL DATA

The MC10117 is a dual 2–wide 2–3–input OR–AND/OR–AND–Invert gate.

This general purpose logic element is designed for use in data control, such as

digital multiplexing or data distribution. Pin 9 is common to both gates.

L SUFFIX

CERAMIC PACKAGE

CASE 620–10

= 100 mW typ/pkg (No Load)

= 2.3 ns typ

t , t = 2.2 ns typ (20%–80%)

r f

P SUFFIX

PLASTIC PACKAGE

CASE 648–08

FN SUFFIX

PLCC

CASE 775–02

LOGIC DIAGRAM

DIP

PIN ASSIGNMENT

CC1

CC2

OUT

= PIN 1

= PIN 16

= PIN 8

A2 , B2

CC1

CC2

Pin assignment is for Dual–in–Line Package.

For PLCC pin assignment, see the Pin Conversion

Tables on page 6–11 of the Motorola MECL Data

Book (DL122/D).

3/93

Motorola, Inc. 1996

REV 5

3–68

12 3 4 5

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