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MC10105FNR2

更新时间: 2024-11-25 04:59:43
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安森美 - ONSEMI 栅极触发器逻辑集成电路输入元件
页数 文件大小 规格书
5页 104K
描述
Triple 2-3-2-Input OR/NOR Gate

MC10105FNR2 技术参数

是否Rohs认证:不符合生命周期:Obsolete
零件包装代码:QLCC包装说明:PLASTIC, LCC-20
针数:20Reach Compliance Code:not_compliant
HTS代码:8542.39.00.01风险等级:5.48
Is Samacsys:N其他特性:ASYMMETRICAL I/PS
系列:10KJESD-30 代码:S-PQCC-J20
JESD-609代码:e0长度:8.9662 mm
逻辑集成电路类型:OR/NOR GATE湿度敏感等级:1
功能数量:3输入次数:3
端子数量:20最高工作温度:85 °C
最低工作温度:-30 °C封装主体材料:PLASTIC/EPOXY
封装代码:QCCJ封装等效代码:LDCC20,.4SQ
封装形状:SQUARE封装形式:CHIP CARRIER
包装方法:TAPE AND REEL电源:-5.2 V
最大电源电流(ICC):23 mAProp。Delay @ Nom-Sup:3.3 ns
传播延迟(tpd):2.9 ns认证状态:Not Qualified
施密特触发器:NO座面最大高度:4.57 mm
子类别:Gates表面贴装:YES
技术:ECL温度等级:OTHER
端子面层:Tin/Lead (Sn/Pb)端子形式:J BEND
端子节距:1.27 mm端子位置:QUAD
宽度:8.9662 mmBase Number Matches:1

MC10105FNR2 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
The MC10105 is a triple 2–3–2 input OR/NOR gate.  
P
= 30 mW typ/gate (No Load)  
= 2.0 ns typ  
D
t
pd  
L SUFFIX  
CERAMIC PACKAGE  
CASE 620–10  
t , t = 2.0 ns typ (20%–80%)  
r f  
P SUFFIX  
PLASTIC PACKAGE  
CASE 648–08  
LOGIC DIAGRAM  
FN SUFFIX  
PLCC  
CASE 775–02  
4
5
3
2
9
10  
11  
6
7
DIP  
PIN ASSIGNMENT  
13  
12  
14  
15  
V
A
V
CC2  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
CC1  
C
C
C
C
OUT  
OUT  
OUT  
OUT  
IN  
A
V
V
V
= PIN 1  
= PIN 16  
= PIN 8  
CC1  
CC2  
EE  
A
IN  
A
IN  
IN  
B
B
B
IN  
IN  
IN  
OUT  
B
B
OUT  
V
EE  
Pin assignment is for Dual–in–Line Package.  
For PLCC pin assignment, see the Pin Conversion  
Tables on page 6–11 of the Motorola MECL Data  
Book (DL122/D).  
3/93  
Motorola, Inc. 1996  
REV 5  

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