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MC10104P

更新时间： 2024-09-29 04:59:43
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安森美 - ONSEMI 栅
页数 文件大小 规格书
8页 108K
描述
Quad 2-Input AND Gate

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MC10104P 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP-16
针数：16Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.45
系列：10KJESD-30 代码：R-PDIP-T16
JESD-609代码：e0长度：19.175 mm
逻辑集成电路类型：AND GATE功能数量：4
输入次数：2端子数量：16
最高工作温度：85 °C最低工作温度：-30 °C
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP16,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：-5.2 V最大电源电流（ICC）：39 mA
Prop。Delay @ Nom-Sup：4.3 ns传播延迟（tpd）：4 ns
认证状态：Not Qualified施密特触发器：NO
座面最大高度：4.44 mm子类别：Gates
表面贴装：NO技术：ECL
温度等级：OTHER端子面层：Tin/Lead (Sn/Pb)
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.62 mmBase Number Matches：1

MC10104P 数据手册

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MC10104  
Quad 2-Input AND Gate  
The MC10104 is a quad 2–input AND gate. One of the gates has  
both AND/NAND outputs available.  
• P = 35 mW typ/gate (No Load)  
D
• t = 2.7 ns typ  
pd  
http://onsemi.com  
• t , t = 2.0 ns typ (20%–80%)  
r
f
LOGIC DIAGRAM  
MARKING  
DIAGRAMS  
4
5
2
16  
CDIP–16  
L SUFFIX  
CASE 620  
MC10104L  
AWLYYWW  
6
7
3
1
10  
11  
14  
16  
12  
13  
9
PDIP–16  
P SUFFIX  
CASE 648  
MC10104P  
AWLYYWW  
15  
V
V
= PIN 1  
= PIN 16  
= PIN 8  
CC1  
1
CC2  
1
V
EE  
PLCC–20  
FN SUFFIX  
CASE 775  
10104  
AWLYYWW  
DIP  
PIN ASSIGNMENT  
A
= Assembly Location  
V
A
V
CC2  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
CC1  
WL = Wafer Lot  
YY = Year  
WW = Work Week  
D
C
D
D
C
C
D
OUT  
OUT  
OUT  
IN  
B
OUT  
A
IN  
ORDERING INFORMATION  
A
IN  
IN  
Device  
Package  
Shipping  
B
IN  
IN  
MC10104L  
CDIP–16  
25 Units / Rail  
B
IN  
IN  
MC10104P  
PDIP–16  
PLCC–20  
25 Units / Rail  
46 Units / Rail  
V
OUT  
EE  
MC10104FN  
Pin assignment is for Dual–in–Line Package.  
For PLCC pin assignment, see the Pin Conversion Tables on page 18  
of the ON Semiconductor MECL Data Book (DL122/D).  
Semiconductor Components Industries, LLC, 2002  
1
Publication Order Number:  
January, 2002 – Rev. 7  
MC10104/D  
12345678

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MC10104P 替代型号

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