Datasheet > 驱动程序和接口 > 电平转换器> MC100LVEL91DW

MC100LVEL91DW

更新时间： 2024-01-22 18:19:33

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摩托罗拉 - MOTOROLA		转换器电平转换器驱动程序和接口接口集成电路光电二极管
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Triple PECL to ECL T ranslator

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MC100LVEL91DW 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
包装说明：	SOP, SOP20,.4	Reach Compliance Code：	unknown
风险等级：	5.89	Is Samacsys：	N
接口集成电路类型：	PECL TO ECL TRANSLATOR	JESD-30 代码：	R-PDSO-G20
JESD-609代码：	e0	端子数量：	20
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP20,.4	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	电源：	+-3.3/-5 V
认证状态：	Not Qualified	子类别：	Level Translators
表面贴装：	YES	技术：	ECL100K
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	Base Number Matches：	1

MC100LVEL91DW 数据手册

SEMICONDUCTOR TECHNICAL DATA

The MC100LVEL/EL91 is a triple PECL to ECL translator. The

MC100LVEL91 receives low voltage PECL signals and translates them to

differential ECL output signals. The MC100EL91 receives standard

voltage PECL signals and translates them to differential ECL output

signals.

• MC100LVEL91 Supports Low Voltage Operation

• MC100LVEL91 Has 620ps Typical Propagation Delays

• MC100EL91 Supports Standard Voltage Operation

• MC100EL91 Has 670ps Typical Propagation Delays

• Fully Differential Design

• 20–lead SOIC Packaging

DW SUFFIX

20–LEAD PLASTIC SOIC WIDE PACKAGE

CASE 751D–04

A V

output is provided for interfacing with single ended PECL signals

output should be

at the input. If a single ended input is to be used the V

connected to the D input. The active signal would then drive the D input.

When used the V output should be bypassed to ground via a 0.01µF

capacitor. The V

for the EL/LVEL91 under single ended input switching conditions, as a

result this pin can only source/sink up to 0.5mA of current.

output is designed to act as the switching reference

To accomplish the level translation the EL/LVEL91 requires three

power rails. The V

supply should be connected to the positive supply,

pin should be connected to the negative power supply. The

and the V

PIN NAMES

GND pins are connected to the system ground plain. Both V

and V

Pins

Function

should be bypassed to ground via 0.01µF capacitors.

Under open input conditions, the D input will be biased at V /2 and

the D input will be pulled to GND. This condition will force the Q output to

a low, ensuring stability.

PECL_V

PECL/LVPECL Inputs

ECL/LVECL Outputs

PECL Reference Voltage Output

GND

ECL

PECL

Figure 1. 20–Lead Pinout (Top View) and Logic Diagram

8/97

Motorola, Inc. 1997

REV 1

4–1

12 3 4

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型号	品牌	获取价格	描述	数据表
MC100LVEL91DWG	ONSEMI	获取价格	3.3 V Triple LVPECL Input to −3.3 V to −5.0 V ECL Output Translator
MC100LVEL91DWR2	ONSEMI	获取价格	3.3 V Triple LVPECL Input to −3.3 V to −5.0 V ECL Output Translator
MC100LVEL91DWR2G	ONSEMI	获取价格	3.3 V Triple LVPECL Input to −3.3 V to −5.0 V ECL Output Translator
MC100LVEL92	ONSEMI	获取价格	Triple PECL to LVPECL Translator
MC100LVEL92_06	ONSEMI	获取价格	5V Triple PECL Input to LVPECL Output Translator
MC100LVEL92DW	ONSEMI	获取价格	5V Triple PECL Input to LVPECL Output Translator
MC100LVEL92DW	MOTOROLA	获取价格	Triple PECL to LVPECL Translator
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