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M74VHC1GT50DFT1G

更新时间： 2024-01-10 21:23:27
品牌 Logo 应用领域
安森美 - ONSEMI 转换器电平转换器
页数 文件大小 规格书
6页 78K
描述
Noninverting Buffer / CMOS Logic Level Shifter TTL−Compatible Inputs

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M74VHC1GT50DFT1G 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOT-353
包装说明：TSSOP,针数：5
Reach Compliance Code：unknown风险等级：5.73
系列：AHC/VHCJESD-30 代码：R-PDSO-G5
JESD-609代码：e3长度：2 mm
逻辑集成电路类型：BUFFER湿度敏感等级：NOT SPECIFIED
功能数量：1输入次数：1
端子数量：5最高工作温度：125 °C
最低工作温度：-55 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
传播延迟（tpd）：25.5 ns认证状态：COMMERCIAL
座面最大高度：1.1 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：1.65 V标称供电电压 (Vsup)：1.8 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：MATTE TIN
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：1.25 mmBase Number Matches：1

M74VHC1GT50DFT1G 数据手册

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MC74VHC1GT50  
Noninverting Buffer /  
CMOS Logic Level Shifter  
TTL−Compatible Inputs  
The MC74VHC1GT50 is a single gate noninverting buffer  
fabricated with silicon gate CMOS technology. It achieves high speed  
operation similar to equivalent Bipolar Schottky TTL while  
maintaining CMOS low power dissipation.  
http://onsemi.com  
MARKING  
DIAGRAMS  
The internal circuit is composed of three stages, including a buffer  
output which provides high noise immunity and stable output.  
The device input is compatible with TTL−type input thresholds and  
the output has a full 5 V CMOS level output swing. The input protection  
circuitry on this device allows overvoltage tolerance on the input,  
allowing the device to be used as a logic−level translator from 3 V  
CMOS logic to 5 V CMOS Logic or from 1.8 V CMOS logic to 3 V  
CMOS Logic while operating at the high−voltage power supply.  
The MC74VHC1GT50 input structure provides protection when  
voltages up to 7 V are applied, regardless of the supply voltage. This  
allows the MC74VHC1GT50 to be used to interface high voltage to  
low voltage circuits. The output structures also provide protection  
5
5
VL M G  
1
G
SC−88A/SOT−353/SC−70  
DF SUFFIX  
1
5
CASE 419A  
5
VL M G  
G
1
TSOP−5/SOT−23/SC−59  
DT SUFFIX  
1
when V = 0 V. These input and output structures help prevent  
CC  
device destruction caused by supply voltage − input/output voltage  
mismatch, battery backup, hot insertion, etc.  
CASE 483  
Features  
VL = Device Code  
M
G
= Date Code*  
= Pb−Free Package  
• Designed for 1.65 V to 5.5 V Operation  
CC  
• High Speed: t = 3.5 ns (Typ) at V = 5 V  
PD  
CC  
(Note: Microdot may be in either location)  
• Low Power Dissipation: I = 1 mA (Max) at T = 25°C  
CC  
A
*Date Code orientation and/or position may vary  
depending upon manufacturing location.  
• TTL−Compatible Inputs: V = 0.8 V; V = 2.0 V, V = 5 V  
IL  
IH  
CC  
• CMOS−Compatible Outputs: V > 0.8 V ; V < 0.1 V @Load  
OH  
CC  
OL  
CC  
• Power Down Protection Provided on Inputs and Outputs  
• Balanced Propagation Delays  
• Pin and Function Compatible with Other Standard Logic Families  
• Chip Complexity: FETs = 104; Equivalent Gates = 26  
• Pb−Free Packages are Available  
PIN ASSIGNMENT  
1
2
3
4
5
NC  
IN A  
GND  
OUT Y  
V
CC  
NC  
5
V
CC  
1
2
3
FUNCTION TABLE  
IN A  
A Input  
Y Output  
GND  
4
OUT Y  
L
L
H
H
Figure 1. Pinout (Top View)  
1
ORDERING INFORMATION  
IN A  
OUT Y  
See detailed ordering and shipping information in the package  
dimensions section on page 4 of this data sheet.  
Figure 2. Logic Symbol  
© Semiconductor Components Industries, LLC, 2007  
1
Publication Order Number:  
February, 2007 − Rev. 13  
MC74VHC1GT50/D  
123456

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M74VHC1GT50DFT1G 替代型号

型号 品牌 替代类型 描述 数据表
M74VHC1GT50DFT2G ONSEMI

完全替代

 Noninverting Buffer / CMOS Logic Level Shifter TTL−Compatible Inputs
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