M74HC595C1R

更新时间： 2024-11-08 22:25:31

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意法半导体 - STMICROELECTRONICS		移位寄存器触发器锁存器逻辑集成电路输出元件
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8 BIT SHIFT REGISTER WITH OUTPUT LATCHES 3 STATE

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M74HC595C1R 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	QFN	包装说明：	CC-20
针数：	20	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.73
Is Samacsys：	N	其他特性：	PARALLEL OUTPUT IS REGISTERED; UNREGISTERED SERIAL SHIFT RIGHT OUTPUT
计数方向：	RIGHT	系列：	HC/UH
JESD-30 代码：	S-PQCC-J20	JESD-609代码：	e3
长度：	8.9662 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	SERIAL IN PARALLEL OUT	最大频率@ Nom-Sup：	24000000 Hz
位数：	8	功能数量：	1
端子数量：	20	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	QCCJ	封装等效代码：	LDCC20,.4SQ
封装形状：	SQUARE	封装形式：	CHIP CARRIER
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	2/6 V
传播延迟（tpd）：	31 ns	认证状态：	Not Qualified
座面最大高度：	4.57 mm	子类别：	Shift Registers
最大供电电压 (Vsup)：	6 V	最小供电电压 (Vsup)：	2 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn)	端子形式：	J BEND
端子节距：	1.27 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	触发器类型：	POSITIVE EDGE
宽度：	8.9662 mm	最小 fmax：	24 MHz
Base Number Matches：	1

M74HC595C1R 数据手册

M54HC595

M74HC595

8 BIT SHIFT REGISTER WITH OUTPUT LATCHES (3 STATE)

HIGH SPEED

f_MAX= 55 MHz (TYP.) AT V_CC= 5 V

LOW POWER DISSIPATION

I_CC= 4 µA (MAX.) AT T_A= 25 °C

HIGH NOISE IMMUNITY

V_NIH= V_NIL= 28 % V_CC(MIN.)

OUTPUT DRIVE CAPABILITY

B1R

(Plastic Package)

F1R

15 LSTTL LOADS FOR QA TO QH

10 LSTTL LOADS FOR QH’

(Ceramic Package)

SYMMETRICAL OUTPUT IMPEDANCE

|I_OH| = I_OL= 6 mA (MIN.) FOR QA TO QH

|I_OH| = I_OL= 4 mA (MIN.) FOR QH’

BALANCED PROPAGATION DELAYS

t_PLH= t_PHL

WIDE OPERATING VOLTAGE RANGE

V_CC(OPR) = 2 V TO 6 V

PIN AND FUNCTION COMPATIBLE

M1R

(Micro Package)

C1R

(Chip Carrier)

ORDER CODES :

M54HC595F1R

M74HC595B1R

M74HC595M1R

M74HC595C1R

WITH LSTTL 54/74LS595

PIN CONNECTIONS (top view)

DESCRIPTION

The M54/74HC595 is a high speed CMOS 8-BIT

SHIFT REGISTERS/OUTPUT LATCHES (3-

STATE) fabricated in silicon C²MOS technology. It

has the same high speed performance of LSTTL

combined with true CMOS low power consumption.

This device contains an 8-bit serial-in, parallel-out

shift register that feeds an 8-bit D-type storage reg-

ister. The storage register has 8 3-STATE outputs.

Separate clocks are provided for both the shift reg-

ister and the storage register.

The shift register has a direct-overriding clear, serial

input, and serial output (standard) pins for cascad-

ing. Both the shift register and storage register use

positive-edge triggered clocks. If both clocks are

connected together, the shift register state will al-

ways be one clock pulse ahead of the storage reg-

ister.

NC =

All inputs are equipped with protection circuits

against static discharge and transient excess volt-

age.

No Internal

Connection

April 1993

1/13

12 3 4 5 6 7...13

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