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Datasheet > 逻辑 > 总线驱动器/收发器> M74HC564TTR
M74HC564TTR PDF预览

M74HC564TTR

更新时间： 2024-11-23 05:00:51
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 总线驱动器总线收发器触发器逻辑集成电路光电二极管输出元件
页数 文件大小 规格书
11页 407K
描述
OCTAL D-TYPE FLIP FLOP WITH 3 STATE OUTPUT INVERTING

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M74HC564TTR 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP, TSSOP20,.25针数：20
Reach Compliance Code：not_compliantHTS代码：8542.39.00.01
风险等级：5.54Is Samacsys：N
系列：HC/UHJESD-30 代码：R-PDSO-G20
JESD-609代码：e0长度：6.5 mm
负载电容（CL）：50 pF逻辑集成电路类型：BUS DRIVER
最大频率@ Nom-Sup：21000000 Hz最大I（ol）：0.006 A
位数：8功能数量：1
端口数量：2端子数量：20
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：3-STATE输出极性：INVERTED
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP20,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：NOT SPECIFIED电源：2/6 V
传播延迟（tpd）：285 ns认证状态：Not Qualified
座面最大高度：1.2 mm子类别：FF/Latches
最大供电电压 (Vsup)：6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：4.5 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：POSITIVE EDGE
宽度：4.4 mmBase Number Matches：1

M74HC564TTR 数据手册

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M74HC564  
OCTAL D-TYPE FLIP FLOP  
WITH 3 STATE OUTPUT INVERTING  
■
■
■
■
■
■
■
HIGH SPEED:  
= 90MHz (TYP.) at V = 6V  
f
MAX  
CC  
LOW POWER DISSIPATION:  
= 4µA(MAX.) at T =25°C  
I
CC  
A
HIGH NOISE IMMUNITY:  
= V = 28 % V (MIN.)  
V
NIH  
NIL  
CC  
DIP  
SOP  
TSSOP  
T & R  
SYMMETRICAL OUTPUT IMPEDANCE:  
|I | = I = 6mA (MIN)  
OH  
OL  
BALANCED PROPAGATION DELAYS:  
t
t
ORDER CODES  
PACKAGE  
PLH  
PHL  
WIDE OPERATING VOLTAGE RANGE:  
(OPR) = 2V to 6V  
TUBE  
V
CC  
DIP  
SOP  
M74HC564B1R  
M74HC564M1R  
PIN AND FUNCTION COMPATIBLE WITH  
74 SERIES 564  
M74HC564RM13TR  
M74HC564TTR  
TSSOP  
DESCRIPTION  
The M74HC564 is an high speed CMOS OCTAL  
D-TYPE FLIP FLOP WITH 3-STATE OUTPUTS  
INVERTING fabricated with silicon gate C MOS  
level) and while high level the outputs will be in a  
high impedance state.  
The output control does not affect the internal  
operation of flip-flops; that is, the old data can be  
retained or the new data can be entered even  
while the outputs are off.  
All inputs are equipped with protection circuits  
against static discharge and transient excess  
voltage.  
2
technology.  
This 8 bit D-TYPE FLIP FLOP is controlled by a  
clock input (CK) and an output enable input (OE).  
On the positive transition of the clock, the Q  
outputs will be set to the logic state that were  
setup at the D inputs.  
While the OE input is at low level, the eight outputs  
will be in a normal logic state (high or low logic  
PIN CONNECTION AND IEC LOGIC SYMBOLS  
August 2001  
1/11  
1234567...11

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型号 品牌 获取价格 描述 数据表
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