Datasheet > 信号电路 > 锁相环或频率合成电路> M64811AGP

M64811AGP

更新时间： 2024-02-25 13:48:44

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三菱 - MITSUBISHI		信号电路锁相环或频率合成电路光电二极管移动电话信息通信管理蜂窝
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9页	51K
描述
1.1GHz/500MHz DUAL PLL FREQUENCY SYNTHESIZER FOR DIGITAL CELLULAR PHONE

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M64811AGP 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOP, SSOP16,.25
针数：	16	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.92
Is Samacsys：	N	模拟集成电路 - 其他类型：	PLL FREQUENCY SYNTHESIZER
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e0
功能数量：	1	端子数量：	16
最高工作温度：	85 °C	最低工作温度：	-30 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SSOP16,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	3.3 V	认证状态：	Not Qualified
子类别：	PLL or Frequency Synthesis Circuits	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	2.7 V	标称供电电压 (Vsup)：	3 V
表面贴装：	YES	技术：	BICMOS
温度等级：	OTHER	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	0.635 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
Base Number Matches：	1

M64811AGP 数据手册

MITSUBISHI ICs (COMMUNICATION)

M64811AGP

1.1GHz/500MHz DUAL PLL FREQUENCY SYNTHESIZER FOR DIGITAL CELLULAR PHONE

DESCRIPTION

PIN CONFIGURATION (TOP VIEW)

The M64811AGP is a 1.1GHz/500MHz band two-system

one-chip PLL frequency synthesizer .

FIN1

GND

PD1

Vcc

Using a high performance Bi-CMOS process , the product

contains one two-modulus (1/32 and 1/33) prescaler that

accepts inputs up to 1.1GHz and another two-modulus

(1/16 and 1/17) prescaler that accepts inputs up to

500MHz ,thus helping make the equipment compact .

CPS

XIN

XOUT

XBo

SLEEP1

SLEEP2

FIN2

LOCK

GND

PD2

FEATURES

• Operating supply voltage : 2.7V~3.6V

• Operating temperature : -30°C~+85°C

• 2 PLL systems (1.1GHz and 500MHz) are on one chip .

PLL1 : 700MHz~1.1GHz

PLL2 : 100MHz~500MHz

• Low power consumption (Icc=8mA Typ at Vcc=3V) .

• Dividing ratio setting ranges :

FIN1 for 1.1GHz VCO• • • • • N(VCO1)=1,024~131,071

FIN2 for 500MHz VCO• • • • • N(VCO2)=256~131,071

OSC for Fref • • • • • • • • • • • • • N(Fref)=5~2,047

• Each loop has input pin for sleep mode .

Power supplies to 2 loops can be independently turned ON/OFF .

Also can be controlled by the serial data . (When SLEEP1 and SLEEP2 is "H" . )

• The PLL standard oscillation circuit can adopt a B-E Colpitts type oscillation circuit to from a stable

oscillation circuit.

• Current controlled charge pump . (Icp=±2mA const.)

• Locked condition detecting output

If a phase difference smaller than 3 times (∆t) of the OSC period continues for 15 periods or

longer , the condition is judged as locked, and the LOCK terminal goes to "L" .

(When , for example , fosc=19.2 MHz , ∆t=156 ns)

• PLL lock/unlock status indicate function .

(Judged in the system turned on if the other system is turned off . )

• Small package (16pin SSOP, lead pitch : 0.65mm)

APPLICATION

• Digital cordless phone (CT2)

• Digital cellular phone (PDC)

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