M54HC131F1R

更新时间： 2024-11-03 22:13:15

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意法半导体 - STMICROELECTRONICS		解码器驱动器逻辑集成电路输入元件双倍数据速率
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3 TO 8 LINE DECODER/LATCH

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M54HC131F1R 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	DIP, DIP16,.3	针数：	16
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.65
Is Samacsys：	N	其他特性：	ADDRESS REGISTERS; 2 ENABLE INPUTS
系列：	HC/UH	JESD-30 代码：	R-GDIP-T16
JESD-609代码：	e0	负载电容（CL）：	50 pF
逻辑集成电路类型：	OTHER DECODER/DRIVER	最大频率@ Nom-Sup：	22700000 Hz
最大I（ol）：	0.004 A	功能数量：	1
端子数量：	16	最高工作温度：	125 °C
最低工作温度：	-55 °C	输出极性：	INVERTED
封装主体材料：	CERAMIC, GLASS-SEALED	封装代码：	DIP
封装等效代码：	DIP16,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	2/6 V	Prop。Delay @ Nom-Sup：	60 ns
传播延迟（tpd）：	60 ns	认证状态：	Not Qualified
座面最大高度：	5.08 mm	子类别：	Decoder/Drivers
最大供电电压 (Vsup)：	6 V	最小供电电压 (Vsup)：	2 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	MILITARY
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7.62 mm
Base Number Matches：	1

M54HC131F1R 数据手册

M54HC131

M74HC131

3 TO 8 LINE DECODER/LATCH

HIGH SPEED

t_PD= 22 ns (TYP.) AT V_CC= 5 V

LOW POWER DISSIPATION

I_CC= 4 µA (MAX.) at T_A= 25 °C

HIGH NOISE IMMUNITY

VNIH = VNIL = 28 % VCC (MIN.)

OUTPUT DRIVE CAPABILITY

10 LSTTL LOADS

SYMMETRICAL OUTPUT IMPEDANCE

| I_OH| = I_OL= 4 mA (MIN.)

BALANCED PROPAGATION DELAYS

t_PLH= t_PHL

B1R

(Plastic Package)

F1R

(Ceramic Package)

WIDE OPERATING VOLTAGE RANGE

V_CC(OPR) = 2 V to 6 V

PIN AND FUNCTION COMPATIBLE WITH

54/74LS131

M1R

(Micro Package)

C1R

(Chip Carrier)

ORDER CODES :

M54HC131F1R

M74HC131B1R

M74HC131M1R

M74HC131C1R

PIN CONNECTIONS (top view)

DESCRIPTION

The M54/74HC131 is a high speed CMOS 3 TO 8

LINE DECODER/LATCH fabricated in silicon gate

C2MOS technology.

It has the same high speed performance of LSTTL

combined with true CMOS low power consumption.

This device is a DECODER/LATCH capable of se-

lectingarbitrarily one of eight outputs by three binary

inputs A, B, and C, in this case, the selected output

is at logic ”low”.

Also, when ENABLE input G1 is set low or ENABLE

input G2 is set high, selection is inhibited regardless

of other input signals and all the outputs are at high.

All inputs are equipped with protection circuits

against static discharge and transient excess volt-

age.

NC =

No Internal

Connection

October 1992

1/12

12 3 4 5 6 7...12

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