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Datasheet > 逻辑 > 总线驱动器/收发器> M54HC125K1
M54HC125K1 PDF预览

M54HC125K1

更新时间： 2024-11-03 22:34:27
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 总线驱动器总线收发器逻辑集成电路
页数 文件大小 规格书
9页 122K
描述
RAD-HARD QUAD BUS BUFFER (3-STATE)

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M54HC125K1 技术参数

是否无铅：含铅是否Rohs认证：不符合
生命周期：Obsolete零件包装代码：DFP
包装说明：DFP, FL14,.3针数：14
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.76Is Samacsys：N
控制类型：ENABLE LOW系列：HC/UH
JESD-30 代码：R-CDFP-F14JESD-609代码：e0
长度：9.95 mm负载电容（CL）：50 pF
逻辑集成电路类型：BUS DRIVER最大I（ol）：0.006 A
位数：1功能数量：4
端口数量：2端子数量：14
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：CERAMIC, METAL-SEALED COFIRED封装代码：DFP
封装等效代码：FL14,.3封装形状：RECTANGULAR
封装形式：FLATPACK峰值回流温度（摄氏度）：NOT SPECIFIED
电源：2/6 VProp。Delay @ Nom-Sup：22 ns
传播延迟（tpd）：160 ns认证状态：Not Qualified
子类别：Bus Driver/Transceivers最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：4.5 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：TIN LEAD
端子形式：FLAT端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
总剂量：50k Rad(Si) V宽度：6.91 mm
Base Number Matches：1

M54HC125K1 数据手册

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M54HC125  
RAD-HARD QUAD BUS BUFFER (3-STATE)  
■
■
■
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■
■
■
HIGH SPEED:  
= 8ns (TYP.) at V = 6V  
t
PD  
CC  
LOW POWER DISSIPATION:  
= 4µA(MAX.) at T =25°C  
I
CC  
A
HIGH NOISE IMMUNITY:  
= V = 28% V (MIN.)  
V
NIH  
NIL  
CC  
DILC-14  
FPC-14  
SYMMETRICAL OUTPUT IMPEDANCE:  
|I | = I = 6mA (MIN)  
OH  
OL  
BALANCED PROPAGATION DELAYS:  
t
t
ORDER CODES  
PACKAGE  
PLH  
PHL  
WIDE OPERATING VOLTAGE RANGE:  
(OPR) = 2V to 6V  
FM  
EM  
V
CC  
DILC  
FPC  
M54HC125D  
M54HC125K  
M54HC125D1  
M54HC125K1  
PIN AND FUNCTION COMPATIBLE WITH  
54 SERIES 125  
■
■
SPACE GRADE-1: ESA SCC QUALIFIED  
50 krad QUALIFIED, 100 krad AVAILABLE ON  
REQUEST  
NO SEL UNDER HIGH LET HEAVY IONS  
IRRADIATION  
The device requires the 3-STATE control input G  
to be set high to place the output into the high  
impedance state.  
All inputs are equipped with protection circuits  
against static discharge and transient excess  
voltage.  
■
■
DEVICE FULLY COMPLIANT WITH  
SCC-9401-039  
DESCRIPTION  
The M54HC125 is an high speed CMOS QUAD  
BUFFER (3-STATE) fabricated with silicon gate  
2
C MOS technology.  
PIN CONNECTION  
March 2004  
1/9  
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