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M4A5-256/128-12YNC

更新时间： 2024-10-29 18:46:11

品牌	Logo	应用领域
莱迪思 - LATTICE		时钟输入元件可编程逻辑
页数	文件大小	规格书
62页	2620K
描述
EE PLD, 12ns, CMOS, PQFP208, PLASTIC, QFP-208

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M4A5-256/128-12YNC 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	FQFP,	针数：	208
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.78
最大时钟频率：	52.6 MHz	JESD-30 代码：	S-PQFP-G208
JESD-609代码：	e3	长度：	28 mm
湿度敏感等级：	3	专用输入次数：
I/O 线路数量：	128	端子数量：	208
最高工作温度：	70 °C	最低工作温度：
组织：	0 DEDICATED INPUTS, 128 I/O	输出函数：	MACROCELL
封装主体材料：	PLASTIC/EPOXY	封装代码：	FQFP
封装形状：	SQUARE	封装形式：	FLATPACK, FINE PITCH
峰值回流温度（摄氏度）：	245	可编程逻辑类型：	EE PLD
传播延迟：	12 ns	认证状态：	Not Qualified
座面最大高度：	4.1 mm	最大供电电压：	5.25 V
最小供电电压：	4.75 V	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn)
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	40
宽度：	28 mm	Base Number Matches：	1

M4A5-256/128-12YNC 数据手册

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MACH 4 CPLD Family

High Performance EE CMOS

Programmable Logic

FEATURES

High-performance, EE CMOS 3.3-V & 5-V CPLD families

Flexible architecture for rapid logic designs

— Excellent First-Time-Fit

— SpeedLocking

and reﬁt feature

performance for guaranteed ﬁxed timing

— Central, input and output switch matrices for 100% routability and 100% pin-out retention

High speed

— 5.0ns t Commercial and 7.5ns t Industrial

— 182MHz f

CNT

32 to 512 macrocells; 32 to 768 registers

44 to 352 pins in PLCC, PQFP, TQFP, BGA, or fpBGA packages

Advanced capabilities for easy system integration

— 3.3-V & 5-V JEDEC-compliant operations

— JTAG (IEEE 1149.1) compliant for boundary scan testing

— 3.3-V & 5-V JTAG in-system programming

— PCI compliant (-5/-55/-6/-65/-7/-10/-12 speed grades)

— Safe for mixed supply voltage system designs

— Programmable pull-up or Bus-Friendly inputs and I/Os

— Hot-socketing

— Programmable security bit

— Individual output slew rate control

Flexible architecture for a w ide range of design styles

— D/T registers and latches

— Synchronous or asynchronous mode

— Dedicated input registers

— Programmable polarity

— Reset/ preset swapping

Advanced EE CMOS process provides high-performance, cost-effective solutions

Supported by Vantis DesignDirect

softw are for rapid logic development

— Supports HDL design methodologies with results optimized for Vantis

— Flexibility to adapt to user requirements

— Software partnerships that ensure customer success

Lattice/Vantis and third-party hardw are programming support

— Lattice/VantisPRO (formerly known as MACHPRO ) software for in-system programmability

support on PCs and automated test equipment

— Programming support on all major programmers including Data I/O, BP Microsystems, Advin,

and System General

Publication# 1 7466

Amendment/0

Rev: J

Issue Date: May 1 999

12 3 4 5 6 7...62

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