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M2XXLFXIT

更新时间： 2024-09-18 21:17:31

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		驱动逻辑集成电路
页数	文件大小	规格书
16页	434K
描述
PLL Based Clock Driver, 200 Series, 3 True Output(s), 0 Inverted Output(s), 3 X 3 MM, 0.60 MM HEIGHT, LEAD FREE, MO-220, QFN-16

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M2XXLFXIT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFN
包装说明：	VQCCN,	针数：	16
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.56	系列：	200
输入调节：	STANDARD	JESD-30 代码：	S-XQCC-N16
JESD-609代码：	e4	长度：	3 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	湿度敏感等级：	3
功能数量：	1	反相输出次数：
端子数量：	16	实输出次数：	3
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	UNSPECIFIED	封装代码：	VQCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER, VERY THIN PROFILE
峰值回流温度（摄氏度）：	260	认证状态：	Not Qualified
座面最大高度：	0.6 mm	最大供电电压 (Vsup)：	1.95 V
最小供电电压 (Vsup)：	1.65 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	NICKEL PALLADIUM GOLD	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	20	宽度：	3 mm
最小 fmax：	3 MHz	Base Number Matches：	1

M2XXLFXIT 数据手册

MoBL^®Clock

M200

Two-PLL Programmable Clock Generator

for Portable Applications

Two-PLL Programmable Clock Generator for Portable Applications

Features

Benefits

■ Device Operating Voltage Options:

❐ MoBL Clock M200 Family: 1.8 V

■ Suitable for cell phone, portable, and consumer electronics

applications

■ Multiple high-performance PLLs allow synthesis of unrelated

frequencies

■ Selectable clock output voltages for MoBL Clock M200:

❐ 1.5 V, 1.8 V, 2.5 V, 3.0 V, or 3.3 V

■ Application compatibility in multiple output voltage levels

■ Fully integrated ultra low power phase-locked loops (PLLs)

■ Input reference clock frequency range: 1–48 MHz

■ Output clock frequency range: 3–50 MHz

■ Three I²C™ programmable output clocks

■ Programmable output drive strengths

■ Optional Spread Spectrum capable PLLs with Lexmark or

Linear profile for maximum EMI reduction

■ PLLs can be programmed for system frequency margin tests

■ Meets critical timing requirements in complex system designs

■ Individually enable or disable each output using I²C

■ 150 ps typical cycle-to-cycle jitter

■ Ease of output clock selection using programmable crossbar

■ Optional Spread Spectrum for EMI reduction

■ 16-pin (3 × 3 × 0.6 mm) QFN Package

■ Industrial temperature range

switches

Logic Block Diagram

VDD_CLK1

VDD_CLK2

VDD_CLK3

EXCLKIN

REF SEL

CLK1

CLK2

Output

Dividers

and

Crossbar

Switch

PLL1

MUX

and

Control

PLL2

(SS)

Drive

Logic

Strength

Control

CLK3

SCL

I2C

SDA

PD#/OE

Cypress Semiconductor Corporation

Document Number: 001-29139 Rev. *D

•

198 Champion Court

•

San Jose, CA 95134-1709

•

408-943-2600

Revised January 16, 2013

12 3 4 5 6 7...16

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