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M13S128324A-6BG

更新时间： 2024-09-24 05:44:31

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晶豪 - ESMT		存储内存集成电路动态存储器双倍数据速率
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50页	950K
描述
1M x 32 Bit x 4 Banks Double Data Rate SDRAM

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M13S128324A-6BG 技术参数

生命周期：	Contact Manufacturer	零件包装代码：	BGA
包装说明：	LFBGA,	针数：	144
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.32.00.02	风险等级：	5.17
Is Samacsys：	N	访问模式：	FOUR BANK PAGE BURST
最长访问时间：	0.7 ns	其他特性：	AUTO/SELF REFRESH
JESD-30 代码：	S-PBGA-B144	长度：	12 mm
内存密度：	134217728 bit	内存集成电路类型：	DDR DRAM
内存宽度：	32	功能数量：	1
端口数量：	1	端子数量：	144
字数：	4194304 words	字数代码：	4000000
工作模式：	SYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	4MX32
封装主体材料：	PLASTIC/EPOXY	封装代码：	LFBGA
封装形状：	SQUARE	封装形式：	GRID ARRAY, LOW PROFILE, FINE PITCH
认证状态：	Not Qualified	座面最大高度：	1.4 mm
自我刷新：	YES	最大供电电压 (Vsup)：	2.625 V
最小供电电压 (Vsup)：	2.325 V	标称供电电压 (Vsup)：	2.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子形式：	BALL
端子节距：	0.8 mm	端子位置：	BOTTOM
宽度：	12 mm	Base Number Matches：	1

M13S128324A-6BG 数据手册

ESMT

M13S128324A

DDR SDRAM

1M x 32 Bit x 4 Banks

Double Data Rate SDRAM

Features

JEDEC Standard

Internal pipelined double-data-rate architecture, two data access per clock cycle

Bi-directional data strobe (DQS)

On-chip DLL

Differential clock inputs (CLK and CLK )

DLL aligns DQ and DQS transition with CLK transition

Quad bank operation

CAS Latency : 2; 2.5; 3;4

Burst Type : Sequential and Interleave

Burst Length : 2, 4, 8

All inputs except data & DM are sampled at the rising edge of the system clock(CLK)

Data I/O transitions on both edges of data strobe (DQS)

DQS is edge-aligned with data for reads; center-aligned with data for WRITE

Data mask (DM) for write masking only

V_DD= 2.375V ~ 2.625V, V_DDQ= 2.375V ~ 2.625V

V_DD= 2.5V ~ 2.7V, V_DDQ= 2.5V ~ 2.7V [for speed -3.6]

Auto & Self refresh

32ms refresh period (4K cycle)

SSTL-2 I/O interface

144Ball FBGA and 100 pin LQFP package

Ordering Information:

PRODUCT NO.

MAX FREQ

275MHz

250MHz

200MHz

166MHz

250MHz

200MHz

166MHz

VDD

2.6V

2.5V

PACKAGE

144 Ball FBGA

100 pin LQFP

COMMENTS

Pb-free

M13S128324A -3.6BG

M13S128324A -4BG

M13S128324A -5BG

M13S128324A -6BG

M13S128324A -4LG

M13S128324A -5LG

M13S128324A -6LG

Elite Semiconductor Memory Technology Inc.

Publication Date : Jul. 2009

Revision : 2.3 1/50

12 3 4 5 6 7...50

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型号	品牌	获取价格	描述	数据表
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M13S128324A-6BIG	ESMT	获取价格	1M x 32 Bit x 4 Banks Double Data Rate SDRAM
M13S128324A-6LG	ESMT	获取价格	1M x 32 Bit x 4 Banks Double Data Rate SDRAM
M13S128324A-6LIG	ESMT	获取价格	1M x 32 Bit x 4 Banks Double Data Rate SDRAM
M13S2561616A	ESMT	获取价格	4M x 16 Bit x 4 Banks Double Data Rate SDRAM
M13S2561616A_09	ESMT	获取价格	4M x 16 Bit x 4 Banks Double Data Rate SDRAM
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M13S2561616A-4BG2K	ESMT	获取价格	DDR DRAM, 16MX16, 0.7ns, CMOS, PBGA60, 8 X 13 MM, 1.20 MM HEIGHT, 0.80 MM PITCH, LEAD FREE

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