5秒后页面跳转
捷配首页

Datasheet > 可编程逻辑 > 可编程逻辑器件> LC4128V-10TN128I
LC4128V-10TN128I PDF预览

LC4128V-10TN128I

更新时间： 2024-01-08 15:57:05
品牌 Logo 应用领域
莱迪思 - LATTICE 可编程逻辑器件输入元件时钟
页数 文件大小 规格书
99页 451K
描述
3.3V/2.5V/1.8V In-System Programmable SuperFAST High Density PLDs

阅读下载

获取价格

LC4128V-10TN128I 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFP
包装说明：LFQFP, QFP128,.64SQ,16针数：128
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.41
Is Samacsys：N其他特性：YES
最大时钟频率：86 MHz系统内可编程：YES
JESD-30 代码：S-PQFP-G128JESD-609代码：e3
JTAG BST：YES长度：14 mm
湿度敏感等级：3专用输入次数：4
I/O 线路数量：92宏单元数：128
端子数量：128组织：4 DEDICATED INPUTS, 92 I/O
输出函数：MACROCELL封装主体材料：PLASTIC/EPOXY
封装代码：LFQFP封装等效代码：QFP128,.64SQ,16
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）：260电源：3.3 V
可编程逻辑类型：EE PLD传播延迟：10 ns
认证状态：Not Qualified座面最大高度：1.6 mm
子类别：Programmable Logic Devices最大供电电压：3.6 V
最小供电电压：3 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：0.4 mm端子位置：QUAD
处于峰值回流温度下的最长时间：40宽度：14 mm
Base Number Matches：1

LC4128V-10TN128I 数据手册

 浏览型号LC4128V-10TN128I的Datasheet PDF文件第2页浏览型号LC4128V-10TN128I的Datasheet PDF文件第3页浏览型号LC4128V-10TN128I的Datasheet PDF文件第4页浏览型号LC4128V-10TN128I的Datasheet PDF文件第5页浏览型号LC4128V-10TN128I的Datasheet PDF文件第6页浏览型号LC4128V-10TN128I的Datasheet PDF文件第7页 
®
ispMACH 4000V/B/C/Z Family  
3.3V/2.5V/1.8V In-System Programmable  
TM  
SuperFAST High Density PLDs  
Coolest Power  
November 2007  
Data Sheet DS1020  
TM  
■ Broad Device Offering  
Features  
• Multiple temperature range support  
■ High Performance  
– Commercial: 0 to 90°C junction (T )  
– Industrial: -40 to 105°C junction (T )  
– Extended: -40 to 130°C junction (T )  
• For AEC-Q100 compliant devices, refer to  
LA-ispMACH 4000V/Z Automotive Data Sheet  
j
• f  
= 400MHz maximum operating frequency  
MAX  
j
• t = 2.5ns propagation delay  
PD  
j
• Up to four global clock pins with programmable  
clock polarity control  
• Up to 80 PTs per output  
■ Easy System Integration  
• Superior solution for power sensitive consumer  
applications  
■ Ease of Design  
• Enhanced macrocells with individual clock,  
reset, preset and clock enable controls  
• Up to four global OE controls  
• Operation with 3.3V, 2.5V or 1.8V LVCMOS I/O  
• Operation with 3.3V (4000V), 2.5V (4000B) or  
1.8V (4000C/Z) supplies  
• 5V tolerant I/O for LVCMOS 3.3, LVTTL, and PCI  
interfaces  
• Individual local OE control per I/O pin  
• Excellent First-Time-FitTM and refit  
• Fast path, SpeedLockingTM Path, and wide-PT  
path  
• Wide input gating (36 input logic blocks) for fast  
counters, state machines and address decoders  
• Hot-socketing  
• Open-drain capability  
• Input pull-up, pull-down or bus-keeper  
• Programmable output slew rate  
• 3.3V PCI compatible  
• IEEE 1149.1 boundary scan testable  
• 3.3V/2.5V/1.8V In-System Programmable  
(ISP™) using IEEE 1532 compliant interface  
• I/O pins with fast setup path  
■ Zero Power (ispMACH 4000Z) and Low  
Power (ispMACH 4000V/B/C)  
• Typical static current 10µA (4032Z)  
• Typical static current 1.3mA (4000C)  
• 1.8V core low dynamic power  
• ispMACH 4000Z operational down to 1.6V V  
CC  
• Lead-free package options  
Table 1. ispMACH 4000V/B/C Family Selection Guide  
ispMACH  
4032V/B/C  
ispMACH  
4064V/B/C  
ispMACH  
4128V/B/C  
ispMACH  
4256V/B/C  
ispMACH  
4384V/B/C  
ispMACH  
4512V/B/C  
Macrocells  
32  
64  
128  
256  
384  
512  
I/O + Dedicated Inputs  
30+2/32+4  
30+2/32+4/  
64+10  
64+10/92+4/  
96+4  
64+10/96+14/  
128+4/160+4  
128+4/192+4  
128+4/208+4  
t
(ns)  
2.5  
1.8  
2.5  
1.8  
2.7  
1.8  
3.0  
2.0  
3.5  
2.0  
3.5  
2.0  
PD  
t (ns)  
S
t
f
(ns)  
2.2  
2.2  
2.7  
2.7  
2.7  
2.7  
CO  
(MHz)  
400  
400  
333  
322  
322  
322  
MAX  
Supply Voltages (V)  
Pins/Package  
3.3/2.5/1.8V  
3.3/2.5/1.8V  
3.3/2.5/1.8V  
3.3/2.5/1.8V  
3.3/2.5/1.8V  
3.3/2.5/1.8V  
44 TQFP  
48 TQFP  
44 TQFP  
48 TQFP  
100 TQFP  
100 TQFP  
128 TQFP  
144 TQFP1  
100 TQFP  
144 TQFP1  
176 TQFP  
256 ftBGA2/  
fpBGA2, 3  
176 TQFP  
256 ftBGA/  
fpBGA3  
176 TQFP  
256 ftBGA/  
fpBGA3  
1. 3.3V (4000V) only.  
2. 128-I/O and 160-I/O configurations.  
3. Use 256 ftBGA package for all new designs. Refer to PCN#14A-07 for 256 fpBGA package discontinuance.  
© 2007 Lattice Semiconductor Corp. All Lattice trademarks, registered trademarks, patents, and disclaimers are as listed at www.latticesemi.com/legal. All other brand  
or product names are trademarks or registered trademarks of their respective holders. The specifications and information herein are subject to change without notice.  
www.latticesemi.com  
1
DS1020_23.0  
1234567...99

下载PDF

与LC4128V-10TN128I相关器件

型号 品牌 描述 获取价格 数据表
LC4128V-10TN144I LATTICE 3.3V/2.5V/1.8V In-System Programmable SuperFAST High Density PLDs

获取价格
LC4128V-27T100C LATTICE 3.3V/2.5V/1.8V In-System Programmable SuperFAST High Density PLDs

获取价格
LC4128V-27T128C LATTICE 3.3V/2.5V/1.8V In-System Programmable SuperFAST High Density PLDs

获取价格
LC4128V-27T128I LATTICE EE PLD, 3.5ns, 128-Cell, CMOS, PQFP128,

获取价格
LC4128V-27T144C LATTICE 3.3V/2.5V/1.8V In-System Programmable SuperFAST High Density PLDs

获取价格
LC4128V-27TN100C LATTICE 3.3V/2.5V/1.8V In-System Programmable SuperFAST High Density PLDs

获取价格

与LC4128V-10TN128I相关文章

您还可以找


热门产品
PCB打样/小批量
铝基板
BOM智能配单
PCBA制造
钣金
精密CNC
模具注塑
薄膜开关
精选活动
PCBA打样特惠
四六层板品质升级
铝基板品质升级
一体化电子制造
DFM下载
服务支持
企业认证
产品展示
工厂展示
工艺能力
积分商城
关于捷配
捷配简介
企业文化
公司动态
人才招聘
联系我们
帮助中心
下单流程
付款流程
开票流程
常见问题
全球PCB制造服务专线 400-613-0088

工作时间：9:00-21:00

CEO邮箱：ceo@jiepei.com

投诉邮箱：tousu@jiepei.com

捷配网-微信公众号 微信公众号
捷配网-微信公众号 抖音公众号
资质认证：
合作快递：
支付方式：
Copyright © 2024 Jiepei.com Inc. All Rights Reserved. 版权所有:杭州捷配信息科技有限公司 浙公网安备 33010502006866号 浙ICP备10014259号-119 营业执照ICP证