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IDTCV149PAG

更新时间： 2024-11-16 21:12:03

品牌	Logo	应用领域
艾迪悌 - IDT		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
17页	251K
描述
Processor Specific Clock Generator, 400MHz, PDSO56, GREEN, TSSOP-56

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IDTCV149PAG 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	GREEN, TSSOP-56
针数：	56	Reach Compliance Code：	unknown
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.5	JESD-30 代码：	R-PDSO-G56
JESD-609代码：	e3	长度：	14 mm
湿度敏感等级：	1	端子数量：	56
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	400 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP56,.3,20
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	3.3 V
主时钟/晶体标称频率：	14.31818 MHz	认证状态：	Not Qualified
座面最大高度：	1.1 mm	子类别：	Clock Generators
最大压摆率：	400 mA	最大供电电压：	3.465 V
最小供电电压：	3.135 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn) - annealed
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	6.1 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：	1

IDTCV149PAG 数据手册

IDTCV149

COMMERCIALTEMPERATURERANGE

PROGRAMMABLEFLEXPC™CLOCKFORAMDK8PROCESSORATIRS480

IDTCV149

PROGRAMMABLE FLEXPC™

CLOCK FOR AMD K8

PROCESSOR ATI RS480

DESCRIPTION:

FEATURES:

IDTCV149is a 56pinclockdevice forAMDadvance K8processors. The

CPUoutputbufferisdesignedtosupportupto400MHzprocessor. Thisdevice

alsoimplementsBand-gapreferencedIREFtoreducetheimpactofVDDvariation

ondifferentialoutputs,whichcanprovidemorerobustsystemperformance.

EachCPU/SRCclockhasitsownSpreadSpectrumselection,whichallows

forisolatedchangesinsteadofaffecting otherclockgroups.

• One high precision N and SSC programmable PLL for CPU

• One high precision N and SSC programmable PLL for SRC[2:1]

• One high precision N and SSC programmable PLL for SRC0

[7:3] (PCI Express)

• One high precision PLL for 48MHz

• Band-gap circuit for differential outputs

• Support multiple spread spectrum modulation, down and

center

• Support SMBus block read/write, index read/write

• Selectable output strength for REF, PCI, 48MHz, HTT66

• Available in SSOP and TSSOP packages

KEYSPECIFICATION:

• CPU CLK cycle to cycle jitter < 85ps

• SRC CLK cycle to cycle jitter < 100ps

• Static PLL frequency divide error = 0 ppm

FUNCTIONALBLOCKDIAGRAM

SRC

SSC

N Programming

SRC[7:3], 0

PCI0

SRC

PCI/

SRC PLL

SSC

N Programming

14.318MHz

Osc

SRC/

Host/

SRC[2:1]

CLKREQ0#

CLKREQ1#

CPU PLL

SSC

N Programming

CPU[1:0]

HTT66

TURBO1#

USB48

Fixed PLL

No SSC

48MHz/

24_48MHz

REF[2:0]

Reset#

OUTPUTTABLE

CPU

CLKREQ

SRC

HTT66

PCI

TURBO

USB48

24_48

REF

RESET#

TheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.

COMMERCIAL TEMPERATURE RANGE

MAY 2004

DSC - 6497/2

12 3 4 5 6 7...17

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