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IDT74FCT163373C

更新时间： 2024-02-22 14:39:11

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艾迪悌 - IDT		锁存器
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3.3V CMOS 16-BIT TRANSPARENT LATCH

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IDT74FCT163373C 技术参数

生命周期：	Active	零件包装代码：	SSOP
包装说明：	SSOP,	针数：	48
Reach Compliance Code：	unknown	风险等级：	5.18
其他特性：	MAX O/P SKEW = 0.5NS; TYP VOLP = 0.3V	系列：	FCT
JESD-30 代码：	R-PDSO-G48	JESD-609代码：	e0
长度：	15.875 mm	逻辑集成电路类型：	BUS DRIVER
位数：	8	功能数量：	2
端口数量：	2	端子数量：	48
最高工作温度：	85 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	SSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
传播延迟（tpd）：	13 ns	认证状态：	COMMERCIAL
座面最大高度：	2.794 mm	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	2.7 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	TIN LEAD
端子形式：	GULL WING	端子节距：	0.635 mm
端子位置：	DUAL	宽度：	7.5 mm
Base Number Matches：	1

IDT74FCT163373C 数据手册

IDT74FCT163373/A/C

3.3V CMOS

16-BIT TRANSPARENT

LATCH

Integrated Device Technology, Inc.

FEATURES:

• 0.5 MICRON CMOS Technology

DESCRIPTION:

TheFCT163373/A/C16-bit transparentD-typelatchesare

built using advanced dual metal CMOS technology. These

high-speed, low-power latches are ideal for temporary stor-

age of data. They can be used for implementing memory

address latches, I/O ports, and bus drivers. The Output

Enable and Latch Enable controls are organized to operate

each device as two 8-bit latches or one 16-bit latch. Flow-

throughorganizationofsignalpinssimplifieslayout. Allinputs

are designed with hysteresis for improved noise margin.

The inputs of FCT163373/A/C can be driven from either

3.3V or 5V devices. This feature allows the use of these

transparent latches as translators in a mixed 3.3V/5V supply

system. With xLE inputs HIGH, the FCT163373/A/C can be

used as buffers to connect 5V components to a 3.3V bus.

• Typical tSK(o) (Output Skew) < 250ps

• ESD > 2000V per MIL-STD-883, Method 3015;

> 200V using machine model (C = 200pF, R = 0)

• Packages include 25 mil pitch SSOP, 19.6 mil pitch

TSSOP and 15.7 mil pitch TVSOP

• Extended commercial range of -40°C to +85°C

• VCC = 3.3V ±0.3V, Normal Range or

VCC = 2.7 to 3.6V, Extended Range

• CMOS power levels (0.4µW typ. static)

• Rail-to-Rail output swing for increased noise margin

• Low Ground Bounce (0.3V typ.)

• Inputs (except I/O) can be driven by 3.3V or 5V

components

FUNCTIONAL BLOCK DIAGRAM

1OE

1LE

2OE

2LE

1D1

2D1

1O1

2O1

TO 7 OTHER CHANNELS

2601 drw 02

2601 drw 01

The IDT logo is a registered trademark of Integrated Device Technology, Inc.

COMMERCIAL TEMPERATURE RANGE

1996 Integrated Device Technology, Inc.

AUGUST 1996

8.4

DSC-2601/6

12 3 4 5 6 7

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