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IDT74FCT162511CTPA8

更新时间： 2024-10-28 14:33:59

品牌	Logo	应用领域
艾迪悌 - IDT		光电二极管输出元件逻辑集成电路触发器
页数	文件大小	规格书
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描述
Registered Bus Transceiver, FCT Series, 1-Func, 16-Bit, True Output, CMOS, PDSO56, TSSOP-56

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IDT74FCT162511CTPA8 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	TSSOP-56
针数：	56	Reach Compliance Code：	not_compliant
风险等级：	5.44	Is Samacsys：	N
其他特性：	INDEPENDENT OUTPUT ENABLE FOR EACH DIRECTION; PARITY GENERATION/ERROR DETECTION A TO B	控制类型：	INDEPENDENT CONTROL
计数方向：	BIDIRECTIONAL	系列：	FCT
JESD-30 代码：	R-PDSO-G56	JESD-609代码：	e0
长度：	14 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	REGISTERED BUS TRANSCEIVER	最大I（ol）：	0.024 A
湿度敏感等级：	1	位数：	16
功能数量：	1	端口数量：	2
端子数量：	56	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE WITH SERIES RESISTOR
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP56,.3,20
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：	TAPE AND REEL	峰值回流温度（摄氏度）：	240
电源：	5 V	Prop。Delay @ Nom-Sup：	4.2 ns
传播延迟（tpd）：	5.3 ns	认证状态：	Not Qualified
座面最大高度：	1.2 mm	子类别：	Bus Driver/Transceivers
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	20	翻译：	N/A
触发器类型：	POSITIVE EDGE	宽度：	6.1 mm
Base Number Matches：	1

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IDT54/74FCT162511AT/CT

FASTCMOS16-BITREGISTERED/LATCHEDTRANSCEIVER

MILITARYANDINDUSTRIALTEMPERATURERANGES

FAST CMOS 16-BIT

IDT54/74FCT162511AT/CT

REGISTERED/LATCHED

TRANSCEIVER WITH PARITY

FEATURES:

DESCRIPTION:

• 0.5 MICRON CMOS Technology

The FCT162511T 16-bit registered/latched transceiver with parity is built

using advanced dual metal CMOS technology. This high-speed, low-power

transceivercombinesD-typelatchesandD-typeflip-flopstoallowdataflowin

transparent, latched, or clocked modes. The device has a parity generator/

checkerintheA-to-BdirectionandaparitycheckerintheB-to-Adirection. Error

checkingisdoneatthebytelevelwithseparateparitybitsforeachbyte. Separate

errorflagsexitsforeachdirectionwithasingleerrorflagindicatinganerrorfor

eitherbyteintheA-to-Bdirectionandaseconderrorflagindicatinganerrorfor

eitherbyteintheB-to-Adirection. Theparityerrorflagsareopendrainoutputs

whichcanbetiedtogetherand/ortiedwithflagsfromotherdevicestoformasingle

error flag or interrupt. The parity error flags are enabled by the OExx control

pins allowing the designer to disable the error flag during combinational

transitions.

ThecontrolpinsLEAB, CLKAB, andOEABcontroloperationintheA-to-B

directionwhileLEBA, CLKBA, andOEBA controltheB-to-Adirection. GEN/

CHKisonlyfortheselectionofA-to-Boperation. TheB-to-Adirectionisalways

incheckingmode. TheODD/EVENselectiscommonbetweenthetwodirections.

Except for the ODD/EVEN control, independent operation can be achieved

betweenthetwodirectionsbyusingthecorrespondingcontrollines.

• Typical tsk(o) (Output Skew) < 250ps, clocked mode

• Low input and output leakage ≤1µA (max)

• ESD > 2000V per MIL-STD-883, Method 3015; > 200V using

machine model (C = 200pF, R = 0)

• VCC = 5V ±10%

• Balanced Output Drivers:

– ±24mA(industrial)

– ±16mA(military)

• Series current limiting resistors

• Generate/Check, Check/Check modes

• Open drain parity error allows wire-OR

• Available in the following packages:

– Industrial: SSOP, TSSOP

– Military: CERPACK

FUNCTIONALBLOCKDIAGRAM

LEAB

CLKAB

Data

OEAB

Parity, data

B0-15

PB1,2

Parity

Latch/

GEN/CHK

Byte

Parity

PERB

Generator/

Checker

A0-15

PA1,2

(Open Drain)

ODD/EVEN

LEBA

CLKBA

Parity, Data

Parity, data

Latch/

OEBA

Byte

Parity

Checking

PERA

(Open Drain)

M^TheI^IDL^TlI^ogT^oiA^sarR^egiY^steredA^traN^demD^arkoI^fIN^ntegD^ratU^edDS^evT^iceR^TeI^chA^noL^logy,IT^nc.EMPERATURE RANGES

MAY 2001

DSC-2916/-

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