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IDT72V73260DAG

更新时间： 2024-11-21 20:11:07
品牌 Logo 应用领域
艾迪悌 - IDT 电信电信集成电路
页数 文件大小 规格书
26页 187K
描述
Digital Time Switch, PQFP144, 20 X 20 MM, 0.50 MM PITCH, TQFP-144

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IDT72V73260DAG 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：QFP
包装说明：20 X 20 MM, 0.50 MM PITCH, TQFP-144针数：144
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.84
JESD-30 代码：S-PQFP-G144JESD-609代码：e3
长度：20 mm湿度敏感等级：3
功能数量：1端子数量：144
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）：260认证状态：Not Qualified
座面最大高度：1.6 mm标称供电电压：3.3 V
表面贴装：YES电信集成电路类型：DIGITAL TIME SWITCH
温度等级：INDUSTRIAL端子面层：MATTE TIN
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：20 mmBase Number Matches：1

IDT72V73260DAG 数据手册

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3.3 VOLT TIME SLOT INTERCHANGE  
DIGITAL SWITCH  
IDT72V73260  
16,384 X 16,384  
•
•
Available in 144-pin (13mm x 13mm) Plastic Ball Grid Array  
(PBGA) and 144-pin (20mm x 20mm) Thin Quad Flatpack (TQFP)  
Operating Temperature Range -40°C to +85°C  
FEATURES:  
•
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•
•
16K x 16K non-blocking switching at 32.768Mb/s  
32 serial input and output streams  
Accepts single-bit single-data streams at 32.768Mb/s  
Per-channel Variable Delay Mode for low-latency applications  
Per-channel Constant Delay Mode for frame integrity applications  
Automatic identification of ST-BUS® and GCI bus interfaces  
Automatic frame offset delay measurement  
Per-stream single data frame delay offset programming  
Per-channel high-impedance output control  
Direct microprocessor access to all internal memories  
Memory block programming for quick setup  
IEEE-1149.1 (JTAG) Test Port  
DESCRIPTION:  
TheIDT72V73260hasanon-blockingswitchcapacityof 16,384x16,384  
channels at 32.768Mb/s. With 32 inputs and 32 outputs, programmable per  
streamcontrol,andavarietyofoperatingmodestheIDT72V73260isdesigned  
fortheTDMtimeslotinterchangefunctionineithervoiceordataapplications.  
Some of the main features of the IDT72V73260 are LOW power 3.3 Volt  
operation, automatic ST-BUS® /GCI sensing, memory block programming,  
simplemicroprocessorinterface,JTAGTestAccessPort(TAP)andperstream  
programmableinputoffsetdelay,variableorconstantthroughputmodes,output  
enable andprocessormode.  
3.3V Power Supply  
FUNCTIONAL BLOCK DIAGRAM  
RESET  
VCC  
GND  
ODE  
TX0  
RX0  
RX1  
Data Memory  
TX1  
MUX  
Receive  
Serial Data  
Streams  
Transmit  
Serial Data  
Streams  
TX15  
TX16/OEI0  
TX17/OEI1  
Connection  
Memory  
Internal  
Registers  
TX31/OEI15  
RX31  
Microprocessor Interface  
Timing Unit  
JTAG Port  
DS CS  
DTA  
TRST  
TMS TDI TCK TDO  
C32i F32i  
FE  
R/W  
A0-A15  
D0-D15  
5932 drw01  
IDTandtheIDTlogoareregisteredtrademarksofIntegratedDeviceTechnology,Inc. TheST-BUS® isatrademarkofMitelCorp.  
JUNE 2004  
1
2004 Integrated Device Technology, Inc. All rights reserved. Product specifications subject to change without notice  
DSC-5932/10  
1234567...26

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IDT72V73260DAG 替代型号

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