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IDT72V3644L15PF9

更新时间： 2024-11-22 10:11:51

品牌	Logo	应用领域
艾迪悌 - IDT		先进先出芯片
页数	文件大小	规格书
34页	397K
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FIFO, 1KX36, 10ns, Synchronous, CMOS, PQFP128, TQFP-128

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IDT72V3644L15PF9 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LFQFP,	针数：	128
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.71	风险等级：	5.69
最长访问时间：	10 ns	其他特性：	PORTB:36 OR 18 OR 9; MAILBOX; AUTO POWER DOWN
周期时间：	15 ns	JESD-30 代码：	R-PQFP-G128
JESD-609代码：	e0	长度：	20 mm
内存密度：	36864 bit	内存宽度：	36
湿度敏感等级：	3	功能数量：	1
端子数量：	128	字数：	1024 words
字数代码：	1000	工作模式：	SYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	1KX36	可输出：	YES
封装主体材料：	PLASTIC/EPOXY	封装代码：	LFQFP
封装形状：	RECTANGULAR	封装形式：	FLATPACK, LOW PROFILE, FINE PITCH
并行/串行：	PARALLEL	峰值回流温度（摄氏度）：	240
认证状态：	Not Qualified	座面最大高度：	1.6 mm
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	3 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	TIN LEAD	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	20	宽度：	14 mm

IDT72V3644L15PF9 数据手册

3.3 VOLT CMOS SyncBiFIFO^TM

WITH BUS-MATCHING

256 x 36 x 2, 512 x 36 x 2,

1,024 x 36 x 2

IDT72V3624

IDT72V3634

IDT72V3644

• Port B bus sizing of 36 bits (long word), 18 bits (word) and 9 bits

(byte)

• Big- or Little-Endian format for word and byte bus sizes

• Master Reset clears data and configures FIFO, Partial Reset

clears data but retains configuration settings

• Mailbox bypass registers for each FIFO

• Free-running CLKA and CLKB may be asynchronous or coinci-

dent (simultaneous reading and writing of data on a single clock

edge is permitted)

• Auto power down minimizes power dissipation

• Available in space saving 128-pin Thin Quad Flatpack (TQFP)

• Pin and functionally compatible version of the 5V operating

IDT723624/723634/723644

FEATURES:

• Memory storage capacity:

IDT72V3624–256 x 36 x 2

IDT72V3634–512 x 36 x 2

IDT72V3644–1,024 x 36 x 2

• Clock frequencies up to 100 MHz (6.5ns access time)

• Two independent clocked FIFOs buffering data in opposite

directions

• Select IDT Standard timing (using EFA, EFB, FFA, and FFB

flags functions) or First Word Fall Through Timing (using ORA,

ORB, IRA, and IRB flag functions)

• Programmable Almost-Empty and Almost-Full flags; each has

three default offsets (8, 16 and 64)

• Serial or parallel programming of partial flags

• Industrial temperature range (–40°C to +85°C) is available

FUNCTIONAL BLOCK DIAGRAM

MBF1

Mail 1

CLKA

Port-A

Control

Logic

CSA

W/RA

ENA

RAM ARRAY

256 x 36

MBA

512 x 36

1,024 x 36

FIFO1,

Mail1

Reset

Logic

MRS1

PRS1

Write

Pointer

Read

Pointer

Status Flag

Logic

EFB/ORB

AEB

FFA/IRA

AFA

FIFO1

FIFO2

SPM

FS0/SD

FS1/SEN

A⁰-A35

Programmable Flag

Offset Registers

Timing

Mode

FWFT

B0-B35

EFA/ORA

Status Flag

Logic

FFB/IRB

AFB

AEA

Read

Pointer

Write

Pointer

FIFO2,

Mail2

Reset

Logic

MRS2

PRS2

RAM ARRAY

256 x 36

512 x 36

CLKB

CSB

W/RB

ENB

MBB

1,024 x 36

Port-B

Control

Logic

Mail 2

SIZE

MBF2

4664 drw01

IDTandtheIDTlogoaretrademarkofIntegratedDeviceTechnology,Inc. SyncBiFIFOisatrademarkofIntegratedDeviceTechnology,Inc.

AUGUST 2001

COMMERCIAL TEMPERATURE RANGE



DSC-4664/4

12 3 4 5 6 7...34

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