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IDT70T9159L12BFG

更新时间： 2024-10-29 13:08:39

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艾迪悌 - IDT		/
页数	文件大小	规格书
16页	190K
描述
Dual-Port SRAM, 8KX9, 25ns, CMOS, PBGA100, FPBGA-100

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IDT70T9159L12BFG 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	BGA
包装说明：	FPBGA-100	针数：	100
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.41	风险等级：	5.84
最长访问时间：	25 ns	其他特性：	FLOW-THROUGH OR PIPELINED ARCHITECTURE
JESD-30 代码：	S-PBGA-B100	JESD-609代码：	e3
长度：	10 mm	内存密度：	73728 bit
内存集成电路类型：	DUAL-PORT SRAM	内存宽度：	9
功能数量：	1	端子数量：	100
字数：	8192 words	字数代码：	8000
工作模式：	SYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	8KX9
封装主体材料：	PLASTIC/EPOXY	封装代码：	LFBGA
封装形状：	SQUARE	封装形式：	GRID ARRAY, LOW PROFILE, FINE PITCH
并行/串行：	PARALLEL	峰值回流温度（摄氏度）：	260
认证状态：	Not Qualified	座面最大高度：	1.5 mm
最大供电电压 (Vsup)：	2.6 V	最小供电电压 (Vsup)：	2.4 V
标称供电电压 (Vsup)：	2.5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	MATTE TIN	端子形式：	BALL
端子节距：	0.8 mm	端子位置：	BOTTOM
处于峰值回流温度下的最长时间：	30	宽度：	10 mm
Base Number Matches：	1

IDT70T9159L12BFG 数据手册

PRELIMINARY

IDT70T9169/59L

HIGH-SPEED 2.5V

16/8K X 9 SYNCHRONOUS

PIPELINED

DUAL-PORT STATIC RAM

ꢀeatures

◆

True Dual-Ported memory cells which allow simultaneous

access of the same memory location

High-speed clock to data access

– Commercial:7.5/9/12ns(max.)

– Industrial:9ns (max.)

Full synchronous operation on both ports

– 4.0ns setup to clock and 0.5ns hold on all control, data, and

addressinputs

– Data input, address, and control registers

– Fast 7.5ns clock to data out in the Pipelined output mode

– Self-timedwriteallowsfastcycletime

◆

Low-power operation

– IDT70T9169/59L

– 12ns cycle time, 83MHz operation in Pipelined output mode

LVTTL- compatible, single 2.5V (±100mV) power supply

Industrial temperature range (–40°C to +85°C) is

available for 66MHz

Available in a 100-pin Thin Quad Flatpack (TQFP) and 100-

pin fine pitch Ball Grid Array (fpBGA) packages.

◆

Active:225mW(typ.)

Standby: 1.5mW (typ.)

◆

Flow-Through or Pipelined output mode on either Port via

the FT/PIPE pins

Counter enable and reset features

Dual chip enables allow for depth expansion without

additional logic

◆

ꢀunctional Block Diagram

R/W

CE0R

CE1R

CE0L

CE1L

0/1

FT/PIPE

0/1

FT/PIPE

I/O0R - I/O8R

I/O0L - I/O8L

I/O

Control

I/O

Control

(1)

13L

13R

Counter/

Address

Reg.

Counter/

Address

Reg.

MEMORY

ARRAY

CLK

ADS

CNTEN

CLK

ADS

CNTEN

CNTRST

5654 drw 01

NOTE:

1. A¹³is a NC for IDT70T9159.

JULY 2002

DSC-5654/1

12 3 4 5 6 7...16

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型号	品牌	获取价格	描述	数据表
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