9DB403DGILFT

更新时间： 2024-01-24 04:17:00

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艾迪悌 - IDT		PC
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19页	278K
描述
Four Output Differential Buffer for PCIe Gen 1 and Gen 2

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9DB403DGILFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	TSSOP
包装说明：	TSSOP, TSSOP28,.25	针数：	28
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	1.11
系列：	9DB	输入调节：	DIFFERENTIAL MUX
JESD-30 代码：	R-PDSO-G28	JESD-609代码：	e3
长度：	9.7 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
湿度敏感等级：	1	功能数量：	1
反相输出次数：		端子数量：	28
实输出次数：	4	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP28,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
电源：	3.3 V	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.05 ns	座面最大高度：	1.2 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	3.465 V
最小供电电压 (Vsup)：	3.135 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn) - annealed	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	4.4 mm
Base Number Matches：	1

9DB403DGILFT 数据手册

DATASHEET

ICS9DB403D

Four Output Differential Buffer for PCIe Gen 1 and Gen 2

Features/Benefits

Description

•

Spread spectrum modulation tolerant, 0 to -0.5% down

spread and +/- 0.25% center spread.

The ICS9DB403 is compatible with the Intel DB400v2 Differential

Buffer Specification.This buffer provides 4 PCI-Express Gen2 clocks.

The ICS9DB403 is driven by a differential output pair from a

CK410B+, CK505 or CK509B main clock generator.

•

Supports undriven differential outputs in PD# and

SRC_STOP# modes for power management.

Key Specifications

Output Features

•

4 - 0.7V current-mode differential output pairs

Supports zero delay buffer mode and fanout mode

Bandwidth programming available

50-100 MHz operation in PLL mode

50-400 MHz operation in Bypass mode

•

Outputs cycle-cycle jitter < 50ps

Outputs skew: 50ps

Phase jitter: PCIe Gen1 < 86ps peak to peak

Phase jitter: PCIe Gen2 < 3.0/3.1ps rms

28-pin SSOP/TSSOP pacakge

Available in RoHS compliant packaging

Supports Commercial (0 to +70°C) and Industrial (-40 to

+85°C) temperature ranges

Functional Block Diagram

-OE(6, 1)

OE(6,5,2,1)

SPREAD

COMPATIBLE

PLL

SRC_IN

SRC_IN#

STOP

LOGIC

DIF(6,5,2,1)

BYPASS#/PLL

SDATA

CONTROL

LOGIC

SCLK

IREF

Note: Polarities shown for OE_INV = 0.

IDT^TM/ICS^TMFour Output Differential Buffer for PCIe and Gen 1 and Gen 2

ICS9DB403D

REV L 10/07/09

12 3 4 5 6 7...19

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