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ICS8725AM-21LF PDF预览

ICS8725AM-21LF

更新时间： 2024-11-16 15:34:39
品牌 Logo 应用领域
艾迪悌 - IDT 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
18页 300K
描述
PLL Based Clock Driver, 8725 Series, 1 True Output(s), 0 Inverted Output(s), PDSO20, 7.50 X 12.80 MM, 2.30 MM HEIGHT, LEAD FREE, MS-013, MO-119, SOIC-20

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ICS8725AM-21LF 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：7.50 X 12.80 MM, 2.30 MM HEIGHT, LEAD FREE, MS-013, MO-119, SOIC-20针数：20
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.65
系列：8725输入调节：DIFFERENTIAL
JESD-30 代码：R-PDSO-G20JESD-609代码：e3
长度：12.8 mm逻辑集成电路类型：PLL BASED CLOCK DRIVER
湿度敏感等级：1功能数量：1
反相输出次数：端子数量：20
实输出次数：1最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP20,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：260电源：3.3 V
Prop。Delay @ Nom-Sup：4.5 ns传播延迟（tpd）：4.5 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.05 ns
座面最大高度：2.65 mm子类别：Clock Drivers
最大供电电压 (Vsup)：3.465 V最小供电电压 (Vsup)：3.135 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
温度等级：COMMERCIAL端子面层：Matte Tin (Sn) - annealed
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：7.5 mm最小 fmax：31.25 MHz
Base Number Matches：1

ICS8725AM-21LF 数据手册

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DIFFERENTIAL-TO-HSTL ZERO DELAY  
CLOCK GENERATOR  
ICS8725-21  
General Description  
Features  
The ICS8725-21 is a highly versatile 1:1 Differential-  
• One differential HSTL output pair  
One differential feedback output pair  
S
IC  
to-HSTL Clock Generator and a member of the  
HiPerClockS™ family of High Performance Clock  
Solutions from IDT. The CLK, nCLK pair can accept  
most standard differential input levels. The  
HiPerClockS™  
• Differential CLK/nCLK input pair  
• CLK/nCLK pair can accept the following differential  
input levels: LVPECL, LVDS, HSTL, HCSL, SSTL  
ICS8725-21 has a fully integrated PLL and can be configured as  
zero delay buffer, multiplier or divider, and has an output frequency  
range of 31.25MHz to 630MHz. The reference divider, feedback  
divider and output divider are each programmable, thereby  
allowing for the following output-to-input frequency ratios: 8:1, 4:1,  
2:1, 1:1, 1:2, 1:4, 1:8. The external feedback allows the device to  
achieve “zero delay” between the input clock and the output  
clocks. The PLL_SEL pin can be used to bypass the PLL for  
system test and debug purposes. In bypass mode, the reference  
clock is routed around the PLL and into the internal output  
dividers.  
• Output frequency range: 31.25MHz to 630MHz  
• Input frequency range: 31.25MHz to 630MHz  
• VCO range: 250MHz to630MHz  
• External feedback for “zero delay” clock regeneration  
with configurable frequencies  
• Programmable dividers allow for the following output-to-input  
frequency ratios: 8:1, 4:1, 2:1, 1:1, 1:2, 1:4, 1:8  
• Cycle-to-cycle jitter: 35ps (maximum)  
• Output skew: 50ps (maximum)  
• Static phase offset: 30ps ± 125ps  
• 3.3V core, 1.8V output operating supply  
• 0°C to 70°C ambient operating temperature  
• Available in both standard (RoHS 5) and lead-free (RoHS 6)  
packages  
• Industrial temperature information available upon request  
Pin Assignment  
Block Diagram  
Pullup  
PLL_SEL  
CLK  
nCLK  
MR  
1
2
20 nc  
Q
nQ  
19  
SEL1  
÷1, ÷2, ÷4, ÷8,  
0
3
4
18 SEL0  
÷16, ÷32,÷64  
VDD  
17  
VDD  
Pulldown  
Pullup  
CLK  
nCLK  
nFB_IN  
FB_IN  
SEL2  
5
6
7
16 PLL_SEL  
QFB  
nQFB  
1
15  
14  
13  
12  
11  
VDDA  
SEL3  
GND  
nQFB  
QFB  
8
VDDO  
PLL  
9
10  
Q
nQ  
8:1, 4:1, 2:1, 1:1,  
1:2, 1:4, 1:8  
Pulldown  
Pullup  
FB_IN  
nFB_IN  
ICS8725-21  
20-Lead SOIC  
7.5mm x 12.8mm x 2.3mm package body  
M Package  
Pulldown  
Pulldown  
Pulldown  
Pulldown  
Pulldown  
Top View  
SEL0  
SEL1  
SEL2  
SEL3  
MR  
IDT™ / ICS™ HSTL ZERO DELAY CLOCK GENERATOR  
1
ICS8725AM-21REV. A FEBRUARY 27, 2008  
1234567...18

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与ICS8725AM-21LF相关器件

型号 品牌 获取价格 描述 数据表
ICS8725AM-21LFT IDT

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 		PLL Based Clock Driver, 8725 Series, 1 True Output(s), 0 Inverted Output(s), PDSO20, 7.50
ICS8725AY-01LFT IDT

获取价格

 		PLL Based Clock Driver, 8725 Series, 5 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7
ICS8725AY-01T IDT

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 		PLL Based Clock Driver, 8725 Series, 5 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7
ICS8725AYI-01 IDT

获取价格

 		PLL Based Clock Driver, 8725 Series, 5 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7
ICS8725AYI-01LFT IDT

获取价格

 		PLL Based Clock Driver, 8725 Series, 5 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7
ICS8725AYI-01T IDT

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 		PLL Based Clock Driver, 8725 Series, 5 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7
ICS8725Y ICSI

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 		DIFFERENTIAL-TO-LVHSTL ZERO DELAY BUFFER
ICS8725YT ICSI

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 		DIFFERENTIAL-TO-LVHSTL ZERO DELAY BUFFER
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 		Differential-to-HSTL Zero Delay Clock Generator
ICS873032AGLF IDT

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 		Low Skew Clock Driver, 873032 Series, 1 True Output(s), 0 Inverted Output(s), PDSO8, 3 X 3

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