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ICS8705BYILF

更新时间： 2024-09-29 20:10:11

品牌	Logo	应用领域
艾迪悌 - IDT		驱动逻辑集成电路
页数	文件大小	规格书
18页	183K
描述
PLL Based Clock Driver, 8 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LEAD FREE, LQFP-32

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ICS8705BYILF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LQFP,	针数：	32
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.71	其他特性：	ALSO OPERATES AT 3.3V SUPPLY
输入调节：	DIFFERENTIAL MUX	JESD-30 代码：	S-PQFP-G32
JESD-609代码：	e3	长度：	7 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	湿度敏感等级：	3
功能数量：	1	反相输出次数：
端子数量：	32	实输出次数：	8
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	LQFP
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE
峰值回流温度（摄氏度）：	260	传播延迟（tpd）：	7.3 ns
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.065 ns
座面最大高度：	1.6 mm	最大供电电压 (Vsup)：	2.625 V
最小供电电压 (Vsup)：	2.375 V	标称供电电压 (Vsup)：	2.5 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn) - annealed	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	7 mm
最小 fmax：	15.625 MHz	Base Number Matches：	1

ICS8705BYILF 数据手册

ICS8705I

NRND

Zero Delay, Differential-to-LVCMOS/

LVTTL Clock Generator

NOT RECOMMENDED FOR NEW DESIGNS

GENERAL DESCRIPTION

FEATURES

The ICS8705I is a highly versatile 1:8 Differential-to- • Eight LVCMOS/LVTTL outputs, 7Ω typical output impedance

LVCMOS/LVTTL Clock Generator. The ICS8705I has two

selectable clock inputs. The CLK1, nCLK1 pair can accept

most standard differential input levels. The single ended

CLK0 input accepts LVCMOS or LVTTL input levels.The

• Selectable CLK1, nCLK1 or LVCMOS/LVTTL clock inputs

• CLK1, nCLK1 pair can accept the following differential

input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL

• CLK0 input accepts LVCMOS or LVTTL input levels

• Output frequency range: 15.625MHz to 250MHz

• Input frequency range: 15.625MHz to 250MHz

• VCO range: 250MHz to 500MHz

ICS8705I has a fully integrated PLL and can be configured

as zero delay buffer, multiplier or divider and has an input

and output frequency range of 15.625MHz to 250MHz. The

reference divider, feedback divider and output divider are

each programmable, thereby allowing for the following out-

put-to-input frequency ratios: 8:1, 4:1, 2:1, 1:1, 1:2, 1:4, 1:8.

The external feedback allows the device to achieve “zero

delay” between the input clock and the output clocks. The

PLL_SEL pin can be used to bypass the PLL for system

test and debug purposes. In bypass mode, the reference

clock is routed around the PLL and into the internal output

dividers.

• External feedback for “zero delay” clock regeneration

with configurable frequencies

• Programmable dividers allow for the following output-to-input

frequency ratios: 8:1, 4:1, 2:1, 1:1, 1:2, 1:4, 1:8

• Fully integrated PLL

• Cycle-to-cycle jitter: 45ps (maximum)

• Output skew: CLK0, 65ps (maximum)

CLK1, nCLK1, 55ps (maximum)

• Static Phase Offset: 25 125ps (maximum), CLK0

• Full 3.3V or 2.5V operating supply

• Lead-Free package available

• -40°C to 85°C ambient operating temperature

• Not Recommended for New Designs

For new designs, contact IDT.

BLOCK DIAGRAM

PLL_SEL

PIN ASSIGNMENT

÷2, ÷4, ÷8, ÷16,

÷32,÷64, ÷128

CLK0

32 31 30 29 28 27 26 25

SEL0

SEL1

VDDO

CLK1

nCLK1

PLL

CLK0

GND

CLK_SEL

8:1, 4:1, 2:1, 1:1,

1:2, 1:4, 1:8

FB_IN

ICS8705

CLK1

VDDO

nCLK1

CLK_SEL

GND

10 11 12 13 14 15 16

SEL0

SEL1

SEL2

SEL3

32-Lead LQFP

7mm x 7mm x 1.4 mm

Y Package

Top View

8705BYI

www.idt.com

REV.E MAY 30, 2013

12 3 4 5 6 7...18

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ICS8705BYILF 替代型号

型号	品牌	替代类型	描述	数据表
MC100LVEP111FARG	ONSEMI	功能相似	2.5V / 3.3V 1:10 Differential ECL/PECL/HSTL Clock Driver
MC100LVEP111FAG	ONSEMI	功能相似	2.5V / 3.3V 1:10 Differential ECL/PECL/HSTL Clock Driver
CDCLVP110VF	TI	功能相似	LOW-VOLTAGE 1:10 LVPECL/HSTL WITH SELECTABLE INPUT CLOCK DRIVER

与ICS8705BYILF相关器件

型号	品牌	获取价格	描述	数据表
ICS8705BYIT	IDT	获取价格	PLL Based Clock Driver, 8 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7 MM, 1.40 MM
ICS8705BYLF	ICSI	获取价格	ZERO DELAY, DIFFERENTIAL-TO-LVCMOS/LVTTL CLOCK GENERATOR
ICS8705BYLFT	ICSI	获取价格	ZERO DELAY, DIFFERENTIAL-TO-LVCMOS/LVTTL CLOCK GENERATOR
ICS8705BYT	ICSI	获取价格	ZERO DELAY, DIFFERENTIAL-TO-LVCMOS/LVTTL CLOCK GENERATOR
ICS870S208BK	IDT	获取价格	Low Skew Clock Driver, 870S Series, 4 True Output(s), 0 Inverted Output(s), 5 X 5 MM, 0.92
ICS870S208BKLF	IDT	获取价格	Low Skew Clock Driver, 870S Series, 4 True Output(s), 0 Inverted Output(s), 5 X 5 MM, 0.92
ICS870S208BKLFT	IDT	获取价格	Low Skew Clock Driver, 870S Series, 4 True Output(s), 0 Inverted Output(s), 5 X 5 MM, 0.92
ICS870S208BKT	IDT	获取价格	Low Skew Clock Driver, 870S Series, 4 True Output(s), 0 Inverted Output(s), 5 X 5 MM, 0.92
ICS871002AGI-02	IDT	获取价格	PLL Based Clock Driver, 871002 Series, 2 True Output(s), 0 Inverted Output(s), PDSO20, 6.5
ICS871002AGI-02LF	IDT	获取价格	PLL Based Clock Driver, 871002 Series, 2 True Output(s), 0 Inverted Output(s), PDSO20, 6.5

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