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ICS854104AGLF

更新时间： 2024-11-11 20:54:19
品牌 Logo 应用领域
艾迪悌 - IDT 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
15页 690K
描述
Low Skew Clock Driver, 854104 Series, 4 True Output(s), 0 Inverted Output(s), PDSO16, 4.40 X 5 MM, 0.92 MM HEIGHT, ROHS COMPLIANT, MO-153, TSSOP-16

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ICS854104AGLF 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：End Of Life零件包装代码：TSSOP
包装说明：TSSOP,针数：16
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.44
系列：854104输入调节：DIFFERENTIAL
JESD-30 代码：R-PDSO-G16JESD-609代码：e3
长度：5 mm逻辑集成电路类型：LOW SKEW CLOCK DRIVER
功能数量：1反相输出次数：
端子数量：16实输出次数：4
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260认证状态：Not Qualified
座面最大高度：1.2 mm最大供电电压 (Vsup)：3.465 V
最小供电电压 (Vsup)：3.135 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES温度等级：COMMERCIAL
端子面层：MATTE TIN端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：4.4 mm
Base Number Matches：1

ICS854104AGLF 数据手册

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ICS854104  
Low Skew, 1-to-4,  
Differential-to-LVDS Fanout Buffer  
DATA SHEET  
General Description  
Features  
The ICS854104 is a low skew, high performance  
1-to-4 Differential-to-LVDS Clock Fanout Buffer and a  
member of the HiPerClockS™ family of High  
Performance Clock Solutions from IDT. Utilizing Low  
Voltage Differential Signaling (LVDS), the ICS854104  
• Four differential LVDS output pairs  
• One differential clock input pair  
S
IC  
HiPerClockS™  
• CLK/nCLK can accept the following differential input levels:  
LVPECL, LVDS, LVHSTL, HCSL, SSTL  
• Each output has an individual OE control  
• Maximum output frequency: 700MHz  
• Translates differential input signals to LVDS levels  
• Additive phase jitter, RMS: 0.232ps (typical)  
• Output skew: 50ps (maximum)  
provides a low power, low noise, solution for distributing clock signals  
over controlled impedances of 100Ω. The ICS854104 accepts a  
differential input level and translates it to LVDS output levels.  
Guaranteed output and part-to-part skew characteristics make the  
ICS854104 ideal for those applications demanding well defined  
performance and repeatability.  
• Part-to-part skew: 350ps (maximum)  
• Propagation delay: 1.3ns (maximum)  
• 3.3V operating supply  
• 0°C to 70°C ambient operating temperature  
• Available in both standard (RoHS 5) and lead-free (RoHS 6)  
packages  
Block Diagram  
Pin Assignment  
Q0  
OE0  
OE1  
OE2  
VDD  
Q0  
1
2
3
4
5
6
7
8
16  
15  
nQ0  
nQ0  
14 Q1  
Pullup  
OE0  
13  
12  
11  
10  
9
nQ1  
Q2  
GND  
CLK  
Q1  
nQ2  
Q3  
nCLK  
OE3  
nQ1  
nQ3  
Pulldown  
CLK  
Pullup  
OE1  
Pullup/Pulldown  
nCLK  
ICS854104  
Q2  
16-Lead TSSOP  
4.4mm x 5.0mm x 0.925mm package body  
G Package  
nQ2  
Pullup  
OE2  
Top View  
Q3  
nQ3  
Pullup  
OE3  
ICS854104AG REVISION A AUGUST 14, 2009  
1
©2009 Integrated Device Technology, Inc.  
1234567...15

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ICS854104AGLF 替代型号

型号 品牌 替代类型 描述 数据表
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