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HEF4027BT-Q100

更新时间： 2024-11-25 19:54:47
品牌 Logo 应用领域
恩智浦 - NXP 光电二极管逻辑集成电路触发器
页数 文件大小 规格书
13页 105K
描述
IC J-K FLIP-FLOP, FF/Latch

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HEF4027BT-Q100 技术参数

生命周期：Transferred零件包装代码：SOIC
包装说明：SOP,针数：16
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.66系列：4000/14000/40000
JESD-30 代码：R-PDSO-G16长度：9.9 mm
逻辑集成电路类型：J-K FLIP-FLOP位数：2
功能数量：2端子数量：16
最高工作温度：85 °C最低工作温度：-40 °C
输出极性：COMPLEMENTARY封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE传播延迟（tpd）：210 ns
筛选级别：AEC-Q100座面最大高度：1.75 mm
最大供电电压 (Vsup)：15 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL触发器类型：POSITIVE EDGE
宽度：3.9 mm最小 fmax：15 MHz
Base Number Matches：1

HEF4027BT-Q100 数据手册

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HEF4027B-Q100  
Dual JK flip-flop  
Rev. 1 — 26 June 2013  
Product data sheet  
1. General description  
The HEF4027B-Q100 is an edge-triggered dual JK flip-flop which features independent  
set-direct (SD), clear-direct (CD), clock (CP) inputs and outputs (Q, Q). Data is accepted  
when CP is LOW, and transferred to the output on the positive-going edge of the clock.  
The active HIGH asynchronous clear-direct (CD) and set-direct (SD) inputs are  
independent and override the J, K, and CP inputs. The outputs are buffered for best  
system performance. Schmitt trigger action makes the clock input highly tolerant of slower  
rise and fall times.  
It operates over a recommended VDD power supply range of 3 V to 15 V referenced to VSS  
(usually ground). Unused inputs must be connected to VDD, VSS, or another input.  
This product has been qualified to the Automotive Electronics Council (AEC) standard  
Q100 (Grade 3) and is suitable for use in automotive applications.  
2. Features and benefits  
Automotive product qualification in accordance with AEC-Q100 (Grade 3)  
Specified from 40 C to +85 C  
Fully static operation  
5 V, 10 V, and 15 V parametric ratings  
Standardized symmetrical output characteristics  
ESD protection:  
MIL-STD-833, method 3015 exceeds 2000 V  
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V (C = 200 pF, R = 0 )  
Complies with JEDEC standard JESD 13-B  
3. Applications  
Registers  
Counters  
Control circuits  
 
 
 
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与HEF4027BT-Q100相关器件

型号 品牌 获取价格 描述 数据表
HEF4027BT-Q100,118 NXP

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 		J-K Flip-Flop, 4000/14000/40000 Series, 2-Func, Positive Edge Triggered, 2-Bit, Complement
HEF4027BT-Q100J NXP

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 		HEF4027B-Q100 - Dual JK flip-flop SOP 16-Pin
HEF4027BT-T NXP

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 		IC 4000/14000/40000 SERIES, DUAL POSITIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTP
HEF4028B NXP

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 		1-of-10 decoder
HEF4028BD NXP

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