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HD74LV1GT125ACME-E

更新时间： 2024-01-09 16:47:09

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瑞萨 - RENESAS		总线驱动器总线收发器转换器电平转换器逻辑集成电路光电二极管 ISM频段栅
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8页	116K
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LV/LV-A/LVX/H SERIES, 1-BIT DRIVER, TRUE OUTPUT, PDSO5, SC-88A, CMPAK-5

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HD74LV1GT125ACME-E 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SON
包装说明：	VSOF, FL5/6,.047,20	针数：	5
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.45	控制类型：	ENABLE LOW
系列：	LV/LV-A/LVX/H	JESD-30 代码：	R-PDSO-F5
JESD-609代码：	e0	长度：	1.6 mm
负载电容（CL）：	50 pF	逻辑集成电路类型：	BUS DRIVER
最大I（ol）：	0.006 A	湿度敏感等级：	1
位数：	1	功能数量：	1
端口数量：	2	端子数量：	5
最高工作温度：	85 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	VSOF
封装等效代码：	FL5/6,.047,20	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, VERY THIN PROFILE	包装方法：	TAPE AND REEL
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	3.3 V
Prop。Delay @ Nom-Sup：	13 ns	传播延迟（tpd）：	13 ns
认证状态：	Not Qualified	座面最大高度：	0.6 mm
子类别：	Bus Driver/Transceivers	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	3 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子形式：	FLAT
端子节距：	0.5 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	1.2 mm
Base Number Matches：	1

HD74LV1GT125ACME-E 数据手册

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HD74LV1GT125A

Bus Buffer Gate with 3–state Output /

CMOS Logic Level Shifter

REJ03D0123-0900

Rev.9.00

Mar 21, 2008

Description

The HD74LV1GT125A has a bus buffer gate with 3–state output in a 5 pin package. Output is disabled when the

associated output enable (OE) input is high. To ensure the high impedance state during power up or power down, OE

should be connected to V_CCthrough a pull-down resistor; the minimum value of the resistor is determined by the current

sourcing capability of the driver. The input protection circuitry on this device allows over voltage tolerance on the

input, allowing the device to be used as a logic–level translator from 3.0 V CMOS Logic to 5.0 V CMOS Logic or from

1.8 V CMOS logic to 3.0 V CMOS Logic while operating at the high-voltage power supply. Low voltage and high-

speed operation is suitable for the battery powered products (e.g., notebook computers), and the low power

consumption extends the battery life.

Features

•

The basic gate function is lined up as Renesas uni logic series.

Supplied on emboss taping for high-speed automatic mounting.

TTL compatible input level.

Supply voltage range : 3.0 to 5.5 V

Operating temperature range : –40 to +85°C

•

Logic-level translate function

3.0 V CMOS logic → 5.0 V CMOS logic (@V_CC= 5.0 V)

1.8 V or 2.5 V CMOS logic → 3.3 V CMOS logic (@V_CC= 3.3 V)

All inputs V_IH(Max.) = 5.5 V (@V_CC= 0 V to 5.5 V)

All outputs V_O(Max.) = 5.5 V (@V_CC= 0 V, Output : Z)

Output current ±6 mA (@V_CC= 3.0 V to 3.6 V), ±12 mA (@V_CC= 4.5 V to 5.5 V)

All the logical input has hysteresis voltage for the slow transition.

Ordering Information

•

Package Code

(Previous Code)

PTSP0005ZC-A

(CMPAK-5V)

Package

Taping Abbreviation

(Quantity)

Part Name

Package Type

CMPAK–5 pin

VSON–5 pin

Abbreviation

HD74LV1GT125ACME

HD74LV1GT125AVSE

E (3000 pcs/reel)

PUSN0005KA-A

(TNP-5DV)

Note: Please consult the sales office for the above package availability.

REJ03D0123-0900 Rev.9.00, Mar 21, 2008

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型号	品牌	描述	获取价格	数据表
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HD74LV1GT125AVSE	RENESAS	Bus Buffer Gate with 3.state Output / CMOS Logic Level Shifter	获取价格
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