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HD74LS641FPEL

更新时间： 2024-09-15 05:35:15

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瑞萨 - RENESAS		总线驱动器总线收发器逻辑集成电路光电二极管
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描述
Octal Bus Transceivers (non-inverted open-collector outputs)

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HD74LS641FPEL 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOP,
针数：	20	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.4
Is Samacsys：	N	系列：	LS
JESD-30 代码：	R-PDSO-G20	长度：	12.6 mm
逻辑集成电路类型：	BUS TRANSCEIVER	位数：	8
功能数量：	2	端口数量：	2
端子数量：	20	最高工作温度：	75 °C
最低工作温度：	-20 °C	输出特性：	OPEN-COLLECTOR
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	传播延迟（tpd）：	25 ns
认证状态：	Not Qualified	座面最大高度：	2.2 mm
最大供电电压 (Vsup)：	5.25 V	最小供电电压 (Vsup)：	4.75 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	TTL	温度等级：	COMMERCIAL EXTENDED
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	宽度：	5.5 mm
Base Number Matches：	1

HD74LS641FPEL 数据手册

HD74LS641

Octal Bus Transceivers (non-inverted open-collector outputs)

REJ03D0488–0200

Rev.2.00

Feb.18.2005

This octal bus transceivers is designed for asynchronous two-way communication between data buses. The devices

transmit data, from the A bus to the B bus or from the B bus to the A bus depending upon the level at the direction

control (DIR) input. The enable input (G) can be used to disable the device so that the buses are effectively isolated.

Features

•

Ordering Information

Package Code

(Previous Code)

Package

Abbreviation

Taping Abbreviation

(Quantity)

Part Name

Package Type

DILP-20 pin

PRDP0020AC-B

(DP-20NEV)

HD74LS641P

HD74LS641FPEL

—

PRSP0020DD-B

(FP-20DAV)

SOP-20 pin (JEITA)

EL (2,000 pcs/reel)

Note: Please consult the sales office for the above package availability.

Pin Arrangement

DIR

V_CC

Enable G

GND

(Top view)

Rev.2.00, Feb.18.2005, page 1 of 6

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型号	品牌	获取价格	描述	数据表
HD74LS641FP-EL	HITACHI	获取价格	暂无描述
HD74LS641FP-EL	RENESAS	获取价格	暂无描述
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HD74LS641P-E	RENESAS	获取价格	LS SERIES, DUAL 8-BIT TRANSCEIVER, TRUE OUTPUT, PDIP20, 6.30 X 24.50 MM, 2.54 MM PITCH, PL
HD74LS641RP	HITACHI	获取价格	Bus Transceiver, LS Series, 1-Func, 8-Bit, True Output, TTL, PDSO20, FP-20DB
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