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| 是否Rohs认证： | 符合 | 生命周期： | Obsolete |
| 零件包装代码： | DIP | 包装说明： | DIP, DIP16,.3 |
| 针数： | 16 | Reach Compliance Code： | compliant |
| HTS代码： | 8542.39.00.01 | 风险等级： | 5.59 |
| Is Samacsys： | N | 其他特性： | ONE FUNCTION WITH TWO INPUT |
| 控制类型： | ENABLE LOW | 系列： | LS |
| JESD-30 代码： | R-PDIP-T16 | 长度： | 19.2 mm |
| 负载电容（CL）： | 45 pF | 逻辑集成电路类型： | BUS DRIVER |
| 最大I（ol）： | 0.024 A | 湿度敏感等级： | 1 |
| 位数： | 4 | 功能数量： | 1 |
| 端口数量： | 2 | 端子数量： | 16 |
| 最高工作温度： | 75 °C | 最低工作温度： | -20 °C |
| 输出特性： | 3-STATE | 输出极性： | INVERTED |
| 封装主体材料： | PLASTIC/EPOXY | 封装代码： | DIP |
| 封装等效代码： | DIP16,.3 | 封装形状： | RECTANGULAR |
| 封装形式： | IN-LINE | 峰值回流温度（摄氏度）： | NOT SPECIFIED |
| 电源： | 5 V | 最大电源电流（ICC）： | 21 mA |
| Prop。Delay @ Nom-Sup： | 18 ns | 传播延迟（tpd）： | 18 ns |
| 认证状态： | Not Qualified | 座面最大高度： | 5.06 mm |
| 子类别： | Bus Driver/Transceivers | 最大供电电压 (Vsup)： | 5.25 V |
| 最小供电电压 (Vsup)： | 4.75 V | 标称供电电压 (Vsup)： | 5 V |
| 表面贴装： | NO | 技术： | TTL |
| 温度等级： | COMMERCIAL EXTENDED | 端子形式： | THROUGH-HOLE |
| 端子节距： | 2.54 mm | 端子位置： | DUAL |
| 处于峰值回流温度下的最长时间： | NOT SPECIFIED | 宽度： | 7.62 mm |
| Base Number Matches： | 1 |
| 型号 | 品牌 | 获取价格 | 描述 | 数据表 |
| HD74LS368AP-E | RENESAS |
获取价格 |
LS SERIES, 6-BIT DRIVER, INVERTED OUTPUT, PDIP16, DP-16 |
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| HD74LS368ARP | HITACHI |
获取价格 |
Bus Driver, LS Series, 2-Func, 4-Bit, Inverted Output, TTL, PDSO16, FP-16DN |
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| HD74LS368ARP | RENESAS |
获取价格 |
LS SERIES, 6-BIT DRIVER, INVERTED OUTPUT, PDSO16, FP-16DN |
|
| HD74LS368ARPEL | RENESAS |
获取价格 |
Hex Bus Drivers (inverted data outputs with three-state outputs) |
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| HD74LS368ARP-EL | RENESAS |
获取价格 |
LS SERIES, 6-BIT DRIVER, INVERTED OUTPUT, PDSO16, FP-16DN |
|
| HD74LS368ARP-EL | HITACHI |
获取价格 |
Bus Driver, LS Series, 2-Func, 4-Bit, Inverted Output, TTL, PDSO16, FP-16DN |
|
| HD74LS37 | RENESAS |
获取价格 |
Quadruple 2-input Positive NAND Buffers |
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| HD74LS37 | HITACHI |
获取价格 |
Quadruple 2-input Positive NAND Buffers |
|
| HD74LS373 | HITACHI |
获取价格 |
Octal D-type Transparent Latches(with three-state outputs) |
|
| HD74LS373 | RENESAS |
获取价格 |
Octal D-type Transparent Latches (with three-state outputs) |
|
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