HD74LS194AP

更新时间： 2024-09-23 05:35:15

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瑞萨 - RENESAS		移位寄存器触发器逻辑集成电路光电二极管
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4-bit Bidirectional Universal Shift Register

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HD74LS194AP 技术参数

生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	DIP,	针数：	16
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.15	计数方向：	BIDIRECTIONAL
系列：	LS	JESD-30 代码：	R-PDIP-T16
长度：	19.2 mm	逻辑集成电路类型：	PARALLEL IN PARALLEL OUT
位数：	4	功能数量：	1
端子数量：	16	最高工作温度：	75 °C
最低工作温度：	-20 °C	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	DIP
封装形状：	RECTANGULAR	封装形式：	IN-LINE
传播延迟（tpd）：	26 ns	认证状态：	Not Qualified
座面最大高度：	5.06 mm	最大供电电压 (Vsup)：	5.25 V
最小供电电压 (Vsup)：	4.75 V	标称供电电压 (Vsup)：	5 V
表面贴装：	NO	技术：	TTL
温度等级：	COMMERCIAL EXTENDED	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
触发器类型：	POSITIVE EDGE	宽度：	7.62 mm
最小 fmax：	25 MHz	Base Number Matches：	1

HD74LS194AP 数据手册

HD74LS194A

4-bit Bidirectional Universal Shift Register

REJ03D0456–0300

Rev.3.00

Jul.15.2005

The bidirectional shift register is designed to incorporate virtually all of the features a system designer may want in a

shift register. The circuit contains 46 equivalent gates and features parallel inputs, parallel outputs, right-shift and left-

shift serial inputs. Operating-mode-control inputs, and a direct overriding clear line. The register has four distinct

modes of operation, namely;

•

Parallel (broadside) load

Shift right (in the direction Q_Atoward Q_D)

Shift left (in the direction Q_Dtoward Q_A)

Inhibit clock (do nothing)

Synchronous parallel loading is accomplished by applying the four bits of data and taking both mode control inputs, S₀

and S₁, high. The data are loaded into the associated flip-flops and appear at the outputs after the positive transition of

the clock input. During loading, serial data flow is inhibited. Shift right is accomplished synchronously with the rising

edge of the clock pulse when S₀is high and S₁is low. Serial data for this mode is entered at the shift-right data input.

When S₀is low and S₁is high, data shifts left synchronously and new data is entered at the shift-left serial input.

Clocking of the flip-flop is inhibited when both mode control inputs are low.

•

Ordering Information

Package Code

(Previous Code)

Package

Abbreviation

Taping Abbreviation

(Quantity)

Part Name

Package Type

DILP-16 pin

PRDP0016AE-B

(DP-16FV)

HD74LS194AP

HD74LS194AFPEL

—

PRSP0016DH-B

(FP-16DAV)

SOP-16 pin (JEITA)

EL (2,000 pcs/reel)

Note: Please consult the sales office for the above package availability.

Pin Arrangement

Clear

V_CC

Q_A

CLR

Shift Right

Serial Input

Q_A

Q_B

Q_C

Q_D

Q_B

Parallel

Outputs

Q_C

Parallel

Inputs

12 Q_D

S₁

Clock

Shift Left

Serial Input

S₁

S₀

Mode

Control

S₀

GND

(Top view)

Rev.3.00, Jul.15.2005, page 1 of 7

12 3 4 5 6 7 8

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型号	品牌	获取价格	描述	数据表
HD74LS194AP-E	RENESAS	获取价格	LS SERIES, 4-BIT BIDIRECTIONAL PARALLEL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT, PDIP1
HD74LS194ARP	HITACHI	获取价格	Parallel In Parallel Out, LS Series, 4-Bit, Bidirectional, True Output, TTL, PDSO16, FP-16
HD74LS195A	HITACHI	获取价格	4-bit Parallel-Access Shift Registers
HD74LS195A	RENESAS	获取价格	4-bit Parallel-Access Shift Register
HD74LS195AFP	HITACHI	获取价格	Parallel In Parallel Out, LS Series, 4-Bit, Right Direction, True Output, TTL, PDSO16, FP-
HD74LS195AFP-E	RENESAS	获取价格	LS SERIES, 4-BIT RIGHT PARALLEL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT, PDSO16, FP-16
HD74LS195AFPEL	RENESAS	获取价格	4-bit Parallel-Access Shift Register
HD74LS195AFP-EL	RENESAS	获取价格	LS SERIES, 4-BIT RIGHT PARALLEL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT, PDSO16, EIAJ,
HD74LS195AFP-EL	HITACHI	获取价格	暂无描述
HD74LS195AP	RENESAS	获取价格	暂无描述

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