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HCS573HMSR PDF预览

HCS573HMSR

更新时间： 2024-01-14 03:11:04
品牌 Logo 应用领域
英特矽尔 - INTERSIL 锁存器逻辑集成电路驱动
页数 文件大小 规格书
10页 147K
描述
Radiation Hardened Octal Transparent Latch, Three-State

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HCS573HMSR 技术参数

是否Rohs认证： 不符合生命周期：Transferred
包装说明：DFP, FL20,.3Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.72
其他特性：BROADSIDE VERSION OF 373系列：HC/UH
JESD-30 代码：R-CDFP-F20JESD-609代码：e0
负载电容（CL）：50 pF逻辑集成电路类型：BUS DRIVER
最大I（ol）：0.00005 A位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：CERAMIC, METAL-SEALED COFIRED
封装代码：DFP封装等效代码：FL20,.3
封装形状：RECTANGULAR封装形式：FLATPACK
电源：5 VProp。Delay @ Nom-Sup：40 ns
传播延迟（tpd）：40 ns认证状态：Not Qualified
筛选级别：38535V;38534K;883S子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：FLAT
端子节距：1.27 mm端子位置：DUAL
总剂量：200k Rad(Si) VBase Number Matches：1

HCS573HMSR 数据手册

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HCS573MS  
Radiation Hardened  
Octal Transparent Latch, Three-State  
September 1995  
Features  
• 3 Micron Radiation Hardened SOS CMOS  
Pinouts  
20 LEAD CERAMIC DUAL-IN-LINE  
METAL SEAL PACKAGE (SBDIP)  
MIL-STD-1835 CDIP2-T20, LEAD FINISH C  
TOP VIEW  
• Total Dose 200K RAD (Si)  
• SEP Effective LET No Upsets: >100 MEV-cm2/mg  
• Single Event Upset (SEU) Immunity < 2 x 10-9 Errors/Bit-  
Day (Typ)  
1
2
3
4
5
6
7
8
9
VCC  
Q0  
OE  
D0  
D1  
D2  
D3  
D4  
D5  
D6  
D7  
20  
19  
• Dose Rate Survivability: >1 x 1012 RAD (Si)/s  
• Dose Rate Upset >1010 RAD (Si)/s 20ns Pulse  
• Latch-Up Free Under Any Conditions  
• Fanout (Over Temperature Range)  
- Bus Driver Outputs - 15 LSTTL Loads  
• Military Temperature Range: -55oC to +125oC  
• Significant Power Reduction Compared to LSTTL ICs  
• DC Operating Voltage Range: 4.5V to 5.5V  
• Input Logic Levels  
18 Q1  
17 Q2  
16 Q3  
15  
Q4  
14 Q5  
13 Q6  
12  
Q7  
GND 10  
11 LE  
- VIL = 0.3 VCC Max  
- VIH = 0.7 VCC Min  
• Input Current Levels Ii ≤ 5µA at VOL, VOH  
20 LEAD CERAMIC METAL SEAL  
FLATPACK PACKAGE (FLATPACK)  
MIL-STD-1835 CDFP4-F20, LEAD FINISH C  
TOP VIEW  
Description  
The Intersil HCS573MS is a Radiation Hardened octal transpar-  
ent three-state latch with an active low output enable. The  
HCS573MS utilizes advanced CMOS/SOS technology. The  
outputs are transparent to the inputs when the Latch Enable (LE)  
is HIGH. When the Latch Enable (LE) goes LOW, the data is  
latched. The Output Enable (OE) controls the tri-state outputs.  
When the Output Enable (OE) is HIGH, the outputs are in the  
high impedance state. The latch operation is independent of the  
state of the Output Enable.  
OE  
D0  
1
2
3
4
5
6
7
8
9
10  
20  
19  
18  
17  
16  
15  
14  
13  
12  
11  
VCC  
Q0  
Q1  
Q2  
Q3  
Q4  
Q5  
Q6  
Q7  
LE  
D1  
D2  
D3  
D4  
D5  
D6  
The HCS573MS utilizes advanced CMOS/SOS technology to  
achieve high-speed operation. This device is a member of  
radiation hardened, high-speed, CMOS/SOS Logic Family.  
D7  
GND  
The HCS573MS is supplied in a 20 lead Ceramic flatpack  
(K suffix) or a SBDIP Package (D suffix).  
Ordering Information  
PART NUMBER  
HCS573DMSR  
TEMPERATURE RANGE  
SCREENING LEVEL  
Intersil Class S Equivalent  
Intersil Class S Equivalent  
Sample  
PACKAGE  
o
o
-55 C to +125 C  
20 Lead SBDIP  
o
o
HCS573KMSR  
-55 C to +125 C  
20 Lead Ceramic Flatpack  
20 Lead SBDIP  
o
HCS573D/Sample  
HCS573K/Sample  
HCS573HMSR  
+25 C  
o
+25 C  
Sample  
20 Lead Ceramic Flatpack  
Die  
o
+25 C  
Die  
CAUTION: These devices are sensitive to electrostatic discharge; follow proper IC Handling Procedures.  
Spec Number 518771  
File Number 4056  
1-888-INTERSIL or 321-724-7143 | Copyright © Intersil Corporation 1999  
324  
1234567...10

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型号 品牌 获取价格 描述 数据表
HCS573K INTERSIL

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 		Radiation Hardened Octal Transparent Latch, Three-State
HCS573K/SAMPLE RENESAS

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