74174FCQM

更新时间： 2024-01-20 14:56:28

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飞兆/仙童 - FAIRCHILD		触发器
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4页	46K
描述
D Flip-Flop, 6-Func, Positive Edge Triggered, TTL, CDFP16,

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技术参数
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74174FCQM 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	包装说明：	DIP, DIP16,.3
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.83	JESD-30 代码：	R-PDIP-T16
JESD-609代码：	e0	逻辑集成电路类型：	D FLIP-FLOP
功能数量：	6	端子数量：	16
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	DIP
封装等效代码：	DIP16,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	5 V	子类别：	FF/Latches
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	TTL	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	触发器类型：	POSITIVE EDGE
Base Number Matches：	1

74174FCQM 数据手册

September 1986

Revised February 2000

DM74174

Hex/Quad D-Type Flip-Flop with Clear

General Description

These positive-edge triggered flip-flops utilize TTL circuitry

to implement D-type flip-flop logic. All have a direct clear

input.

Features

■ Contains six flip-flops with single-rail outputs

■ Buffered clock and direct clear inputs

■ Individual data input to each flip-flop

■ Applications include:

Information at the D inputs meeting the setup and hold time

requirements is transferred to the Q outputs on the posi-

tive-going edge of the clock pulse. Clock triggering occurs

at a particular voltage level and is not directly related to the

transition time of the positive-going pulse. When the clock

input is at either the HIGH or LOW level, the D input signal

has no effect at the output.

Buffer/storage registers

Shift registers

Pattern generators

■ Typical clock frequency 40 MHz

■ Typical power dissipation per flip-flop 38 mW

Ordering Code:

Order Number Package Number

Package Description

DM74174

N16E

16-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide

Connection Diagram

Function Table

(Each Flip-Flop)

Inputs

Outputs

Clear

Clock

↑

Q₀

H = HIGH Level (steady state)

L = LOW Level (steady state)

X = Don’t Care

↑ = Transition from LOW-to-HIGH level

= The level of Q before the indicated steady-state input conditions were

established.

DS006557

www.fairchildsemi.com

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型号	品牌	描述	获取价格	数据表
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