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EPF8452AQI160-3

更新时间： 2024-02-26 12:31:49

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英特尔 - INTEL		/
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62页	903K
描述
Loadable PLD, CMOS, PQFP160, PLASTIC, QFP-160

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EPF8452AQI160-3 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	QFP, QFP160,1.2SQ	针数：	160
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.2
其他特性：	336 LOGIC ELEMENTS	最大时钟频率：	385 MHz
JESD-30 代码：	S-PQFP-G160	JESD-609代码：	e0
长度：	28 mm	湿度敏感等级：	3
专用输入次数：	4	I/O 线路数量：	120
输入次数：	120	逻辑单元数量：	336
输出次数：	116	端子数量：	160
最高工作温度：	85 °C	最低工作温度：	-40 °C
组织：	4 DEDICATED INPUTS, 120 I/O	输出函数：	REGISTERED
封装主体材料：	PLASTIC/EPOXY	封装代码：	QFP
封装等效代码：	QFP160,1.2SQ	封装形状：	SQUARE
封装形式：	FLATPACK	峰值回流温度（摄氏度）：	220
电源：	3.3/5,5 V	可编程逻辑类型：	LOADABLE PLD
认证状态：	Not Qualified	座面最大高度：	4.07 mm
子类别：	Field Programmable Gate Arrays	最大供电电压：	5.5 V
最小供电电压：	4.5 V	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	28 mm	Base Number Matches：	1

EPF8452AQI160-3 数据手册

FLEX 8000

Programmable Logic

Device Family

January 2003, ver. 11.1

Data Sheet

■

Low-cost, high-density, register-rich CMOS programmable logic

device (PLD) family (see Table 1)

Features...

–

2,500 to 16,000 usable gates

282 to 1,500 registers

System-level features

–

In-circuit reconfigurability (ICR) via external configuration

devices or intelligent controller

–

Fully compliant with the peripheral component interconnect

Special Interest Group (PCI SIG) PCI Local Bus Specification,

Revision 2.2 for 5.0-V operation

–

Built-in Joint Test Action Group (JTAG) boundary-scan test (BST)

circuitry compliant with IEEE Std. 1149.1-1990 on selected devices

MultiVolt^TMI/O interface enabling device core to run at 5.0 V,

while I/O pins are compatible with 5.0-V and 3.3-V logic levels

Low power consumption (typical specification is 0.5 mA or less in

standby mode)

■

Flexible interconnect

–

FastTrack^®Interconnect continuous routing structure for fast,

predictable interconnect delays

–

Dedicated carry chain that implements arithmetic functions such

as fast adders, counters, and comparators (automatically used by

software tools and megafunctions)

–

Dedicated cascade chain that implements high-speed, high-fan-in

logic functions (automatically used by software tools and

megafunctions)

Tri-state emulation that implements internal tri-state nets

■

Powerful I/O pins

Programmable output slew-rate control reduces switching noise

Table 1. FLEX 8000 Device Features

Feature

EPF8282A

EPF8282AV

EPF8452A EPF8636A EPF8820A EPF81188A EPF81500A

Usable gates

2,500

282

4,000

452

6,000

636

8,000

820

12,000

1,188

126

16,000

1,500

162

Flipflops

Logic array blocks (LABs)

Logic elements (LEs)

Maximum user I/O pins

208

336

120

504

136

672

152

1,008

184

1,296

208

Altera Corporation

DS-F8000-11.1

12 3 4 5 6 7...62

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