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EPC4QC100

更新时间： 2024-11-08 22:16:35
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阿尔特拉 - ALTERA 存储内存集成电路LTEPC可编程只读存储器电动程控只读存储器电可擦编程只读存储器时钟
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36页 387K
描述
2. Enhanced Configuration Devices (EPC4, EPC8 & EPC16) Data Sheet

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EPC4QC100 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Transferred零件包装代码：QFP
包装说明：PLASTIC, QFP-100针数：100
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.32.00.51风险等级：4.25
Is Samacsys：N最大时钟频率 (fCLK)：66.7 MHz
JESD-30 代码：R-PQFP-G100JESD-609代码：e0
长度：20 mm内存密度：4194304 bit
内存集成电路类型：CONFIGURATION MEMORY内存宽度：16
湿度敏感等级：3功能数量：1
端子数量：100字数：262144 words
字数代码：256000工作模式：SYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：256KX16封装主体材料：PLASTIC/EPOXY
封装代码：QFP封装等效代码：QFP100,.7X.9
封装形状：RECTANGULAR封装形式：FLATPACK
并行/串行：PARALLEL峰值回流温度（摄氏度）：220
电源：3.3 V认证状态：Not Qualified
座面最大高度：3.4 mm最大待机电流：0.00015 A
子类别：Flash Memories最大压摆率：0.09 mA
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：0.65 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30类型：NOR TYPE
宽度：14 mmBase Number Matches：1

EPC4QC100 数据手册

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2. Enhanced Configuration  
Devices (EPC4, EPC8 &  
EPC16) Data Sheet  
CF52002-2.1  
■
■
Enhanced configuration devices include EPC4, EPC8, and EPC16  
devices  
Single-chip configuration solution for Stratix series, Cyclone™  
Features  
®
series, APEX™ II, APEX 20K (including APEX 20K, APEX 20KC, and  
®
®
APEX 20KE), Mercury™, ACEX 1K, and FLEX 10K (FLEX 10KE  
and FLEX 10KA) devices  
■
Contains 4-, 8-, and 16-Mbit flash memories for configuration data  
storage  
●
On-chip decompression feature almost doubles the effective  
configuration density  
■
■
Standard flash die and a controller die combined into single stacked  
chip package  
External flash interface supports parallel programming of flash and  
external processor access to unused portions of memory  
●
Flash memory block/sector protection capability via external  
flash interface  
●
Supported in EPC16 and EPC4 devices  
■
Page mode support for remote and local reconfiguration with up to  
eight configurations for the entire system  
●
Compatible with Stratix series Remote System Configuration  
feature  
■
■
Supports byte-wide configuration mode fast passive parallel (FPP);  
8-bit data output per DCLKcycle  
Supports true n-bit concurrent configuration (n = 1, 2, 4, and 8) of  
Altera FPGAs  
■
■
Pin-selectable 2-ms or 100-ms power-on reset (POR) time  
Configuration clock supports programmable input source and  
frequency synthesis  
●
Multiple configuration clock sources supported (internal  
oscillator and external clock input pin)  
●
●
External clock source with frequencies up to 133 MHz  
Internal oscillator defaults to 10 MHz; Programmable for higher  
frequencies of 33, 50, and 66 MHz  
●
Clock synthesis supported via user programmable divide  
counter  
■
■
Available in the 100-pin plastic quad flat pack (PQFP) and the 88-pin  
Ultra FineLine BGA packages  
®
●
Vertical migration between all devices supported in the 100-pin  
PQFP package  
Supply voltage of 3.3 V (core and I/O)  
Altera Corporation  
August 2005  
2–1  
1234567...36

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EPC4QC100 替代型号

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EPC4QC100N ALTERA

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