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EP9450-1

更新时间： 2024-11-15 06:53:35
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PCA 延迟线
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1页 17K
描述
16 Pin DIL 3 Bit Programmable ECL Delay Lines

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EP9450-1 数据手册

  
16 Pin DIL 3 Bit Programmable ECL Delay Lines  
DELAYS AND TOLERANCES (in nS)  
PART  
NUMBER  
MINIMUM  
DELAY  
(Inherent)  
MAX IMUM  
DELAY  
(Nom)  
DELAY/STEP  
STEP DELAY  
TOLERANCE  
(Ref. Inherent Delay)  
TRUTH TABLE  
(Programming Pins = CBA)  
000 001 010 011 100 101 110 111  
EP9450-1  
EP9450-2  
EP9450-3  
EP9450-4  
EP9450-5  
EP9450-6  
EP9450-7  
EP9450-8  
EP9450-9  
EP9450-10  
EP9450-15  
EP9450-20  
EP9450-25  
EP9450-30  
EP9450-35  
EP9450-40  
EP9450-45  
EP9450-50  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
3.0 ± .3  
10  
17  
24  
31  
38  
45  
52  
59  
66  
1 ±0.3  
2 ±0.4  
3 ±0.5  
4 ±0.5  
5 ±0.5  
6 ±0.6  
7 ±0.7  
8 ±0.8  
9 ±0.9  
10 ± 1.0  
15 ± 1.5  
20 ± 2.0  
25 ± 2.0  
30 ± 2.0  
35 ± 2.0  
40 ± 2.5  
45 ± 2.5  
50 ± 2.5  
±0.4 nS or ±5%  
±0.6 nS or ±5%  
±0.8 nS or ±5%  
±1.0 nS or ±5%  
±1.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
±2.0 nS or ±5%  
3
3
3
3
3
3
3
3
3
3
3
3
3
3
3
3
3
3
4
5
6
7
8
5
7
9
6
9
7
11  
15  
19  
23  
27  
31  
35  
39  
43  
63  
8
13  
18  
23  
28  
33  
38  
43  
48  
53  
78  
9
10  
15 17  
21 24  
27 31  
33 38  
39 45  
45 52  
51 59  
57 66  
63 73  
93 108  
12  
15  
18  
21  
24  
27  
30  
33  
48  
63  
11  
13  
15  
17  
19  
21  
23  
33  
43  
53  
63  
9
10  
11  
12  
13  
18  
23  
28  
33  
38  
43  
48  
73  
108  
143  
178  
213  
248  
283  
318  
353  
83 103 123 143  
78 103 128 153 178  
93 123 153 183 213  
73 108 143 178 213 248  
83 123 163 203 243 283  
93 138 183 228 273 318  
53 103 153 203 253 303 353  
Delay Times referenced from input to leading edges at 25°C, 5.0V.  
DC Electrical Characterstics  
Schematic  
(V  
= V  
= GRD, V  
= 5.2V ±0.01V  
CCI  
CC2  
EE  
Output Loading With 50 Ohms to -2.0V±0.01V)  
VCC Output  
B
C
9
16  
15  
10  
Test  
Parameter  
Conditions Min  
Max  
Unit  
V
High Level Ouput Voltage  
High Level Output  
Threshold Voltage  
V
= Min  
-960  
-980  
mV  
mV  
OH  
IL  
Programmable Delay Line  
V
OHT  
V
Low Level Ouptut  
Threshold Voltage  
-1630  
mV  
OLT  
V
Low Level Output Voltage  
High Level Input Current  
Low Level Input Current  
V
= Max  
= Max  
= Min  
-1650  
15  
OL  
IH  
1
2
6
7
8
I
V
V
mA  
mA  
mA  
IH  
IH  
VCC  
E
Input  
A
VEE  
I
0.5  
IL  
-I  
IL  
V
EE  
Supply Current  
75  
EE  
Recommended Operating Conditions  
Parameter  
Package  
Min  
Max  
Unit  
V
Supply Voltage (Negative)  
Circuit Ground (Pins 1 and 16)  
High Level Input Voltage  
High Level Input Threshold Voltage  
Low Level Input Voltage  
Low Level Input Threshold Voltage  
Pulse Width of Total Delay  
Duty Cycle  
4.94  
0
-980  
-1105  
-1850 -1630  
5.46  
0
-810  
V
V
EE  
V
CC  
PCA  
White Dot  
Pin 1  
V
mV  
mV  
mV  
mV  
%
IH  
EP9450-1  
Date Code  
V
V
IHT  
IL  
V
-1475  
ILT  
.800 Max.  
P
40  
W*  
.020  
.040  
d*  
40  
%
.275 Max.  
T
Operating Free-Air Temperature  
-30  
+80  
°C  
A
.130 Typ.  
*These two values are inter-dependent.  
.010 x .018 Typ.  
.700  
.100  
Input Pulse Test Conditions @ 25° C  
V
Pulse Input Voltage  
Pulse Width of Total Delay  
Pulse Rise Time  
Pulse Repetition Rate  
Supply Voltage  
-1.0V (-0.75 to - 1.75V)  
3 x Max Delay  
2 nS  
10 x Td  
-5.2V  
IN  
.400 Max.  
.300  
P
IN  
T
RI  
P
V
RR  
EE  
DSD83XX 8/25/94  
QAF-CSO1 Rev. B 8/25/94  
Unless Otherwise Noted Dimensions in Inches  
Tolerances:  
16799 SCHOENBORN ST.  
NORTH HILLS, CA 91343  
TEL: (818) 892-0761  
Fractional = ± 1/32  
E L E C T R O N I C S I N C .  
.XX = ± .030  
.XXX = ± .010  
FAX: (818) 894-5791  
1

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