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| 生命周期： | Obsolete | 包装说明： | BGA, |
| Reach Compliance Code： | compliant | ECCN代码： | 3A991 |
| HTS代码： | 8542.39.00.01 | 风险等级： | 5.58 |
| JESD-30 代码： | S-PBGA-B672 | JESD-609代码： | e1 |
| 长度： | 27 mm | 专用输入次数： | 4 |
| I/O 线路数量： | 382 | 端子数量： | 672 |
| 最高工作温度： | 85 °C | 最低工作温度： | |
| 组织： | 4 DEDICATED INPUTS, 382 I/O | 输出函数： | MACROCELL |
| 封装主体材料： | PLASTIC/EPOXY | 封装代码： | BGA |
| 封装形状： | SQUARE | 封装形式： | GRID ARRAY |
| 可编程逻辑类型： | LOADABLE PLD | 认证状态： | Not Qualified |
| 座面最大高度： | 2.1 mm | 最大供电电压： | 2.625 V |
| 最小供电电压： | 2.375 V | 标称供电电压： | 2.5 V |
| 表面贴装： | YES | 温度等级： | OTHER |
| 端子面层： | TIN SILVER COPPER | 端子形式： | BALL |
| 端子节距： | 1 mm | 端子位置： | BOTTOM |
| 宽度： | 27 mm |
| 型号 | 品牌 | 获取价格 | 描述 | 数据表 |
| EP20K200FC672-2 | INTEL |
获取价格 |
Loadable PLD, PBGA672, 27 X 27 MM, 1 MM PITCH, FINE LINE, BGA-672 |
|
| EP20K200FC672-3 | INTEL |
获取价格 |
Loadable PLD, PBGA672, 27 X 27 MM, 1 MM PITCH, FINE LINE, BGA-672 |
|
| EP20K200FI484-1 | ETC |
获取价格 |
Field Programmable Gate Array (FPGA) |
|
| EP20K200FI484-1ES | ETC |
获取价格 |
FPGA |
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| EP20K200FI484-1X | INTEL |
获取价格 |
Field Programmable Gate Array, 8320-Cell, CMOS, PBGA484 |
|
| EP20K200FI484-2 | ETC |
获取价格 |
Field Programmable Gate Array (FPGA) |
|
| EP20K200FI484-2ES | ETC |
获取价格 |
FPGA |
|
| EP20K200FI484-2N | ALTERA |
获取价格 |
Field Programmable Gate Array, 8320-Cell, CMOS, PBGA484 |
|
| EP20K200FI484-2V | ALTERA |
获取价格 |
Loadable PLD, 3ns, CMOS, PBGA484, FINE LINE, BGA-484 |
|
| EP20K200FI484-3 | ALTERA |
获取价格 |
Loadable PLD, CMOS, PBGA484, 23 X 23 MM, 1 MM PITCH, FINE LINE, BGA-484 |
|
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