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EP15E7C2J-5.000M-TR

更新时间： 2024-11-06 20:46:51

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日蚀 - ECLIPTEK		输出元件振荡器
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2页	122K
描述
CRYSTAL OSCILLATOR, CLOCK, LVCMOS OUTPUT

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EP15E7C2J-5.000M-TR 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	Reach Compliance Code：	unknown
风险等级：	5.71	JESD-609代码：	e4
振荡器类型：	LVCMOS	端子面层：	GOLD OVER NICKEL
Base Number Matches：	1

EP15E7C2J-5.000M-TR 数据手册

EP15E7 Series

EP15E7

• Programmable Crystal Oscillators

• LVCMOS Output

• +2.5V Supply Voltage

• Tri-State and Power Down Options

• 4 Pad Ceramic SMD Package

• RoHS Compliant (Pb-Free)

H 1.05

L 3.2

W 2.5

OSCILLATOR

ELECTRICAL SPECIFICATIONS

3.300MHzꢁ 3.6864MHzꢁ 5.000MHzꢁ 6.000MHzꢁ 7.000MHzꢁ 8.000MHzꢁ 9.000MHzꢁ 10.000MHzꢁ

12.000MHzꢁ 16.000MHz ꢁ 19.200MHzꢁ 20.000MHzꢁ 24.000MHzꢁ 25.000MHzꢁ 26.000MHzꢁ 27.000MHzꢁ

30.000MHzꢁ 33.000MHzꢁ 33.333MHzꢁ 37.500MHzꢁ 40.000MHzꢁ 52.000MHzꢁ 66.000MHzꢁ 70.000MHzꢁ

75.000MHzꢁ 80.000MHzꢁ 83.000MHzꢁ and 88.000MHz

-20°C to 70°C or -40°C to 85°C

Nominal Frequency

Operating Temperature Range

Storage Temperature Range

-55°C to 125°C

Supply Voltage (V_DD

)

2.5V_DC5ꢀ

Input Current

3.300MHz to 25.000MHz

10mA Maximum

25.001MHz to 50.000MHz

12mA Maximum

50.001MHz to 75.000MHz

14mA Maximum

75.001MHz to 88.000MHz

17mA Maximum

Frequency Tolerance / Stability

Output Voltage Logic High (V_OH

Inclusive of All Conditions: Calibration Tolerance at 25°C ꢁ

Frequency Stability over the Operating Temperature Rangeꢁ

Supply Voltage Changeꢁ Output Load Changeꢁ 1st ꢂear

Aging at 25°Cꢁ 260°C Reflowꢁ Shockꢁ and Vibration

I_OH= -8mA

25ppmꢁ 50ppm or 100ppm Maximum

)

90ꢀ of V_DDMinimum

10ꢀ of V_DDMaximum

6nSeconds Maximum

4nSeconds Maximum

2nSeconds Maximum

50 5(ꢀ)

Output Voltage Logic Low (V_OL)

Rise Time / Fall Time

I_OL= +8mA

3.300MHz to 50.000MHzꢁ 20ꢀ to 80ꢀ of waveform

50.001MHz to 75.000MHzꢁ 20ꢀ to 80ꢀ of waveform

75.001MHz to 88.000MHzꢁ 20ꢀ to 80ꢀ of waveform

at 50ꢀ of waveform

Duty Cycle

Load Drive Capability

3.300MHz to 50.000MHz

30pF Maximum

50.001MHz to 88.000MHz

15pF Maximum

Pad 1 Connection

Tri-State or Power Down

Enables Output

Pad 1 Input Voltage

V_IHof 90ꢀ of V_DDMinimum

No Connection

Enables Output

V_ILof 10ꢀ of V_DDMaximum

Disabled Output (Logic Low)

Disabled Output (High Impedance)

3.300MHz to 24.999999MHz

25.000MHz to 88.000MHz

Disables Output

Standby Current

Disable Current

30µA Maximum

6mA Maximum

Absolute Clock Jitter

350pSec Maximum

200pSec Maximum

5ppm/ꢂear Maximum

10mSec Maximum

Aging at 25°

Start Up Time

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