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EBE82AF4A1RA-6E-E

更新时间： 2024-09-18 06:55:27

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尔必达 - ELPIDA		存储内存集成电路动态存储器双倍数据速率时钟
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描述
8GB Registered DDR2 SDRAM DIMM

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EBE82AF4A1RA-6E-E 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	DIMM	包装说明：	DIMM, DIMM240,40
针数：	240	Reach Compliance Code：	unknown
ECCN代码：	EAR99	HTS代码：	8542.32.00.36
风险等级：	5.84	Is Samacsys：	N
访问模式：	FOUR BANK PAGE BURST	最长访问时间：	0.45 ns
其他特性：	AUTO/SELF REFRESH	最大时钟频率 (fCLK)：	333 MHz
I/O 类型：	COMMON	JESD-30 代码：	R-XDMA-N240
JESD-609代码：	e4	内存密度：	77309411328 bit
内存集成电路类型：	DDR DRAM MODULE	内存宽度：	72
功能数量：	1	端口数量：	1
端子数量：	240	字数：	1073741824 words
字数代码：	1000000000	工作模式：	SYNCHRONOUS
最高工作温度：	85 °C	最低工作温度：
组织：	1GX72	输出特性：	3-STATE
封装主体材料：	UNSPECIFIED	封装代码：	DIMM
封装等效代码：	DIMM240,40	封装形状：	RECTANGULAR
封装形式：	MICROELECTRONIC ASSEMBLY	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	1.8 V	认证状态：	Not Qualified
刷新周期：	8192	自我刷新：	YES
子类别：	Other Memory ICs	最大供电电压 (Vsup)：	1.9 V
最小供电电压 (Vsup)：	1.7 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	NO	技术：	CMOS
温度等级：	OTHER	端子形式：	NO LEAD
端子节距：	1 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	Base Number Matches：	1

EBE82AF4A1RA-6E-E 数据手册

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PRELIMINARY DATA SHEET

8GB Registered DDR2 SDRAM DIMM

EBE82AF4A1RA (1024M words × 72 bits, 4 Ranks)

Specifications

Features

• Density: 8GB

• Organization

⎯ 1024M words × 72 bits, 4 ranks

• Mounting 36 pieces of 2G bits DDR2 SDRAM with

DDP (FBGA)

• Double-data-rate architecture; two data transfers per

clock cycle

• The high-speed data transfer is realized by the 4 bits

prefetch pipelined architecture

• Bi-directional differential data strobe (DQS and /DQS)

is transmitted/received with data for capturing data at

the receiver

⎯ DDP: 2 pieces of 1Gb chips sealed in one package

• Package: 240-pin socket type dual in line memory

module (DIMM)

• DQS is edge-aligned with data for READs; center-

aligned with data for WRITEs

⎯ PCB height: 30.0mm

⎯ Lead pitch: 1.0mm

⎯ Lead-free (RoHS compliant)

• Power supply: VDD = 1.8V 0.1V

• Data rate: 667Mbps/533Mbps (max.)

• Differential clock inputs (CK and /CK)

• DLL aligns DQ and DQS transitions with CK

transitions

• Commands entered on each positive CK edge; data

referenced to both edges of DQS

• Posted /CAS by programmable additive latency for

better command and data bus efficiency

• Eight internal banks for concurrent operation

(components)

• Off-Chip-Driver Impedance Adjustment and On-Die-

• Interface: SSTL_18

• Burst lengths (BL): 4, 8

• /CAS Latency (CL): 3, 4, 5

• Precharge: auto precharge option for each burst

access

Termination for better signal quality

• /DQS can be disabled for single-ended Data Strobe

operation

• 1 piece of PLL clock driver, 2 pieces of register driver

and 1 piece of serial EEPROM (2K bits EEPROM) for

Presence Detect (PD)

• Refresh: auto-refresh, self-refresh

• Refresh cycles: 8192 cycles/64ms

⎯ Average refresh period

7.8μs at 0°C ≤ TC ≤ +85°C

3.9μs at +85°C < TC ≤ +95°C

• Operating case temperature range

⎯ TC = 0°C to +95°C

Document No. E1166E10 (Ver. 1.0)

Date Published March 2008 (K) Japan

Printed in Japan

URL: http://www.elpida.com

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