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EBE51ED8AGWA-5C-E

更新时间： 2024-09-18 06:55:27

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尔必达 - ELPIDA		动态存储器双倍数据速率
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描述
512MB Unbuffered DDR2 SDRAM DIMM

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EBE51ED8AGWA-5C-E 技术参数

生命周期：	Obsolete	零件包装代码：	DIMM
包装说明：	DIMM,	针数：	240
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.32.00.36	风险等级：	5.84
访问模式：	SINGLE BANK PAGE BURST	最长访问时间：	0.5 ns
其他特性：	AUTO/SELF REFRESH	JESD-30 代码：	R-XDMA-N240
内存密度：	4831838208 bit	内存集成电路类型：	DDR DRAM MODULE
内存宽度：	72	功能数量：	1
端口数量：	1	端子数量：	240
字数：	67108864 words	字数代码：	64000000
工作模式：	SYNCHRONOUS	最高工作温度：	85 °C
最低工作温度：		组织：	64MX72
封装主体材料：	UNSPECIFIED	封装代码：	DIMM
封装形状：	RECTANGULAR	封装形式：	MICROELECTRONIC ASSEMBLY
认证状态：	Not Qualified	自我刷新：	YES
最大供电电压 (Vsup)：	1.9 V	最小供电电压 (Vsup)：	1.7 V
标称供电电压 (Vsup)：	1.8 V	表面贴装：	NO
技术：	CMOS	温度等级：	OTHER
端子形式：	NO LEAD	端子位置：	DUAL
Base Number Matches：	1

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PRELIMINARY DATA SHEET

512MB Unbuffered DDR2 SDRAM DIMM

EBE51ED8AGWA (64M words × 72 bits, 1 Rank)

Specifications

Features

• Density: 512MB

• Double-data-rate architecture; two data transfers per

clock cycle

• Organization

• The high-speed data transfer is realized by the 4 bits

prefetch pipelined architecture

64M words × 72 bits, 1 rank

• Mounting 9 pieces of 512M bits DDR2 SDRAM

sealed in FBGA

• Bi-directional differential data strobe (DQS and /DQS)

is transmitted/received with data for capturing data at

the receiver

• Package: 240-pin socket type dual in line memory

module (DIMM)

• DQS is edge-aligned with data for READs; center-

aligned with data for WRITEs

PCB height: 30.0mm

Lead pitch: 1.0mm

• Differential clock inputs (CK and /CK)

Lead-free (RoHS compliant)

• Power supply: VDD = 1.8V ± 0.1V

• Data rate: 667Mbps/533Mbps (max.)

• DLL aligns DQ and DQS transitions with CK

transitions

• Commands entered on each positive CK edge; data

and data mask referenced to both edges of DQS

• Four internal banks for concurrent operation

(components)

• Data mask (DM) for write data

• Interface: SSTL_18

• Posted /CAS by programmable additive latency for

better command and data bus efficiency

• Burst lengths (BL): 4, 8

• /CAS Latency (CL): 3, 4, 5

• Off-Chip-Driver Impedance Adjustment and On-Die-

Termination for better signal quality

• Precharge: auto precharge option for each burst

• /DQS can be disabled for single-ended Data Strobe

access

operation

• Refresh: auto-refresh, self-refresh

• Refresh cycles: 8192 cycles/64ms

Average refresh period

7.8µs at 0°C ≤ TC ≤ +85°C

3.9µs at +85°C < TC ≤ +95°C

• Operating case temperature range

TC = 0°C to +95°C

Document No. E0922E10 (Ver. 1.0)

Date Published June 2006 (K) Japan

Printed in Japan

URL: http://www.elpida.com

Elpida Memory, Inc. 2006

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