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DSP56311VL150B1

更新时间： 2024-02-18 01:20:58
品牌 Logo 应用领域
恩智浦 - NXP 时钟外围集成电路
页数 文件大小 规格书
96页 939K
描述
24-BIT, 150 MHz, OTHER DSP, PBGA196, MOLD ARRAY PROCESS, BGA-196

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DSP56311VL150B1 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：BGA包装说明：MOLD ARRAY PROCESS, BGA-196
针数：196Reach Compliance Code：unknown
ECCN代码：3A991HTS代码：8542.31.00.01
风险等级：5.13其他特性：ALSO REQUIRES 3.3V SUPPLY
地址总线宽度：18桶式移位器：YES
边界扫描：YES最大时钟频率：150 MHz
外部数据总线宽度：24格式：FIXED POINT
内部总线架构：MULTIPLEJESD-30 代码：S-PBGA-B196
JESD-609代码：e1长度：15 mm
低功率模式：YES湿度敏感等级：3
端子数量：196封装主体材料：PLASTIC/EPOXY
封装代码：LBGA封装形状：SQUARE
封装形式：GRID ARRAY, LOW PROFILE峰值回流温度（摄氏度）：260
认证状态：Not Qualified座面最大高度：1.6 mm
最大供电电压：1.9 V最小供电电压：1.7 V
标称供电电压：1.8 V表面贴装：YES
技术：CMOS端子面层：Tin/Silver/Copper (Sn/Ag/Cu)
端子形式：BALL端子节距：1 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：40
宽度：15 mmuPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHER
Base Number Matches：1

DSP56311VL150B1 数据手册

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DSP56311  
Rev. 8, 2/2005  
Freescale Semiconductor  
Technical Data  
DSP56311  
24-Bit Digital Signal Processor  
3
16  
6
6
Memory Expansion Area  
The DSP56311 is intended  
for applications requiring a  
large amount of internal  
memory, such as networking  
and wireless infrastructure  
applications. The onboard  
EFCOP can accelerate  
Program  
RAM  
Triple  
Timer  
32 K × 24 bits  
SCI  
HI08  
ESSI  
EFCOP  
or  
X Data  
RAM  
Y Data  
RAM  
31 K × 24 bits  
and  
48 K × 24 bits 48 K × 24 bits  
Instruction  
Cache  
1024 × 24 bits  
Peripheral  
Expansion Area  
general filtering applications,  
such as echo-cancellation  
applications, correlation, and  
general-purpose convolution-  
based algorithms.  
YAB  
Address  
Generation  
Unit  
External  
Address  
Bus  
XAB  
PAB  
DAB  
18  
Address  
Switch  
Six Channel  
DMA Unit  
External  
Bus  
24-Bit  
DSP56300  
Core  
13  
Interface  
and  
Bootstrap  
ROM  
Control  
I - Cache  
Control  
DDB  
YDB  
XDB  
PDB  
GDB  
External  
Data  
Bus  
Internal  
Data  
Bus  
24  
What’s New?  
Rev. 8 includes the following  
changes:  
Switch  
Data  
Switch  
•
Adds lead-free packaging and  
part numbers.  
Power  
Management  
Data ALU  
5
Program  
Interrupt  
Controller  
Program  
Decode  
Controller  
Program  
Address  
Generator  
Clock  
Generator  
+
→
24 × 24 56 56-bit MAC  
Two 56-bit Accumulators  
56-bit Barrel Shifter  
JTAG  
PLL  
OnCE™  
DE  
EXTAL  
XTAL  
RESET  
MODA/IRQA  
MODB/IRQB  
MODC/IRQC  
MODD/IRQD  
PCAP  
PINIT/NMI  
Figure 1. DSP56311 Block Diagram  
The Freescale DSP56311, a member of the DSP56300 DSP family, supports network applications with general filtering  
operations. The Enhanced Filter Coprocessor (EFCOP) executes filter algorithms in parallel with core operations enhancing  
signal quality with no impact on channel throughput or total channels supported. The result is increased overall performance.  
Like the other DSP56300 family members, the DSP56311 uses a high-performance, single-clock-cycle-per- instruction engine  
(DSP56000 code-compatible), a barrel shifter, 24-bit addressing, an instruction cache, and a direct memory access (DMA)  
controller (see Figure 1). The DSP56311 performs at up to 150 million multiply-accumulates per second (MMACS), attaining  
up to 300 MMACS when the EFCOP is in use. It operates with an internal 150 MHz clock with a 1.8 volt core and  
independent 3.3 volt input/output (I/O) power.  
© Freescale Semiconductor, Inc., 1999, 2005. All rights reserved.  
 
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型号 品牌 获取价格 描述 数据表
DSP56311VL150R2 FREESCALE

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 		24-Bit Digital Signal Processor
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 		Digital Signal Processor, 24-Bit Size, 24-Ext Bit, 240MHz, CMOS, PBGA196, FLIP CHIP, PLAST
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 		DSP56321 Reference Manual Addendum
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 		24-BIT, 220MHz, OTHER DSP, PBGA196, PLASTIC, FLIP CHIP, BGA-196
DSP56321TFC220 NXP

获取价格

 		IC,DSP,24-BIT,CMOS,BGA,196PIN,PLASTIC
DSP56321TFC220D MOTOROLA

获取价格

 		24-BIT, 220 MHz, OTHER DSP, PBGA196, 15 X 15 MM, 1 MM PITCH, MOLDED ARRAY PROCESS, BGA-196

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