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DSP56311VF150R2

更新时间： 2024-02-24 08:57:23
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 时钟外围集成电路
页数 文件大小 规格书
100页 1672K
描述
Digital Signal Processor, 24-Ext Bit, 150MHz, CMOS, PBGA196, MAP ARRAY PROCESS, BGA-196

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DSP56311VF150R2 技术参数

生命周期：Transferred零件包装代码：BGA
包装说明：LBGA,针数：196
Reach Compliance Code：unknownECCN代码：3A001.A.3
HTS代码：8542.31.00.01风险等级：5.13
其他特性：ALSO REQUIRES 3.3V SUPPLY地址总线宽度：18
桶式移位器：YES边界扫描：YES
最大时钟频率：150 MHz外部数据总线宽度：24
格式：FIXED POINT内部总线架构：MULTIPLE
JESD-30 代码：S-PBGA-B196长度：15 mm
低功率模式：YES端子数量：196
封装主体材料：PLASTIC/EPOXY封装代码：LBGA
封装形状：SQUARE封装形式：GRID ARRAY, LOW PROFILE
认证状态：Not Qualified座面最大高度：1.6 mm
最大供电电压：1.9 V最小供电电压：1.7 V
标称供电电压：1.8 V表面贴装：YES
技术：CMOS端子形式：BALL
端子节距：1 mm端子位置：BOTTOM
宽度：15 mmuPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHER
Base Number Matches：1

DSP56311VF150R2 数据手册

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Technical Data  
DSP56311/D  
Rev. 5, 4/2003  
24-Bit Digital Signal  
Processor  
3
16  
6
6
Memory Expansion Area  
Program  
RAM  
Triple  
Timer  
32 K × 24 bits  
SCI  
HI08  
ESSI  
EFCOP  
or  
X Data  
RAM  
Y Data  
RAM  
31 K × 24 bits  
and  
48 K × 24 bits 48 K × 24 bits  
Instruction  
Cache  
1024 × 24 bits  
Peripheral  
The DSP56311 is  
intended for  
Expansion Area  
YAB  
Address  
External  
Address  
Bus  
XAB  
PAB  
DAB  
18  
applications requiring  
a large amount of  
on-chip memory, such  
as networking and  
wireless infrastructure  
applications. The  
EFCOP can accelerate  
general filtering  
applications, such as  
echo-cancellation  
applications,  
Generation  
Unit  
Address  
Switch  
Six Channel  
DMA Unit  
External  
Bus  
24-Bit  
DSP56300  
Core  
13  
Interface  
and  
Bootstrap  
ROM  
Control  
I - Cache  
Control  
DDB  
YDB  
XDB  
PDB  
GDB  
External  
Data  
Bus  
Internal  
Data  
24  
Bus  
Switch  
Data  
Switch  
Power  
Management  
Data ALU  
5
Program  
Interrupt  
Controller  
Program  
Decode  
Controller  
Program  
Address  
Clock  
Generator  
+
→
24 × 24 56 56-bit MAC  
Two 56-bit Accumulators  
56-bit Barrel Shifter  
JTAG  
PLL  
Generator  
OnCE™  
correlation, and  
DE  
EXTAL  
XTAL  
RESET  
MODA/IRQA  
MODB/IRQB  
MODC/IRQC  
MODD/IRQD  
general-purpose  
convolution-based  
algorithms.  
PCAP  
PINIT/NMI  
Figure 1. DSP56311 Block Diagram  
The Motorola DSP56311, a member of the  
high-performance, single-clock-cycle-per-  
DSP56300 Digital Signal Processor (DSP) family, instruction engine (DSP56000 code-compatible), a  
supports network applications with general  
filtering operations. The Enhanced Filter  
barrel shifter, 24-bit addressing, an instruction  
cache, and a direct memory access (DMA)  
Coprocessor (EFCOP) executes filter algorithms in controller (see Figure 1). The DSP56311 performs  
parallel with core operations enhancing signal  
quality with no impact on channel throughput or  
total channels supported. The result is increased  
overall performance. Like the other DSP56300  
family members, the DSP56311 uses a  
at 150 million instructions per second (MIPS),  
attaining 270 MIPS when the EFCOP is in use. It  
operates with an internal 150 MHz clock with a  
1.8 volt core and independent 3.3 volt input/output  
(I/O) power.  
1234567...100

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型号 品牌 获取价格 描述 数据表
DSP56311VL150 FREESCALE

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 		24-Bit Digital Signal Processor
DSP56311VL150B1 NXP

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 		24-BIT, 150 MHz, OTHER DSP, PBGA196, MOLD ARRAY PROCESS, BGA-196
DSP56311VL150R2 FREESCALE

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 		24-Bit Digital Signal Processor
DSP56311VL150R2 NXP

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 		24 BIT DSP PBFREE
DSP56321 FREESCALE

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DSP56321FC240 MOTOROLA

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 		Digital Signal Processor, 24-Bit Size, 24-Ext Bit, 240MHz, CMOS, PBGA196, FLIP CHIP, PLAST
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 		24-BIT, 220MHz, OTHER DSP, PBGA196, PLASTIC, FLIP CHIP, BGA-196

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