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DSP56309PV100

更新时间： 2024-09-28 21:10:19

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摩托罗拉 - MOTOROLA		/
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112页	1921K
描述
24-BIT, 100MHz, OTHER DSP, PQFP144, TQFP-144

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DSP56309PV100 技术参数

生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LFQFP, QFP144,.87SQ,20	针数：	144
Reach Compliance Code：	unknown	ECCN代码：	3A001.A.3
HTS代码：	8542.31.00.01	风险等级：	5.84
地址总线宽度：	18	桶式移位器：	YES
位大小：	24	边界扫描：	YES
最大时钟频率：	100 MHz	外部数据总线宽度：	24
格式：	FIXED POINT	内部总线架构：	MULTIPLE
JESD-30 代码：	S-PQFP-G144	长度：	20 mm
低功率模式：	YES	端子数量：	144
封装主体材料：	PLASTIC/EPOXY	封装代码：	LFQFP
封装等效代码：	QFP144,.87SQ,20	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE, FINE PITCH	电源：	3.3 V
认证状态：	Not Qualified	RAM（字数）：	14336
座面最大高度：	1.6 mm	子类别：	Digital Signal Processors
最大供电电压：	3.6 V	最小供电电压：	3 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	20 mm	uPs/uCs/外围集成电路类型：	DIGITAL SIGNAL PROCESSOR, OTHER
Base Number Matches：	1

DSP56309PV100 数据手册

Technical Data

Advance Information

DSP56309/D

Rev. 4, 4/2003

24-Bit Digital Signal

Processor

Memory Expansion Area

Triple

Timer

X Data

RAM

7168 × 24

bits

Y Data

RAM

7168 × 24

bits

(default)

PrograM

RAM

20480 × 24

bits

(default)

HI08

ESSI

SCI

(default)

Peripheral

Expansion Area

The DSP56309 is

intended for

applications benefiting

from a large amount of

on-chip memory, such

as wireless

YAB

Address

External

XAB

PAB

DAB

Generation

Unit

Address

Bus

Address

Switch

Six-Channel

DMA Unit

External

Bus

24-Bit

Interface

and Inst.

Cache

Bootstrap

ROM

DSP56300

Core

Control

infrastructure

applications.

DDB

YDB

XDB

PDB

GDB

External

Data Bus

Switch

Internal

Data

Bus

Data

Switch

Power

EXTAL

XTAL

Management

Clock

Generator

Data ALU

Program

Interrupt

Controller

Program

Decode

Program

Address

Generator

→

56-bit MAC

24 × 24 56

JTAG

Two 56-bit Accumulators

56-bit Barrel Shifter

PLL

Controller

OnCE™

MODA/IRQA

MODB/IRQB

MODC/IRQC

MODD/IRQD

RESET

PINIT/NMI

Figure 1. DSP56309 Block Diagram

The DSP56309 is a member of the DSP56300

core family of programmable CMOS digital

signal processors (DSPs). The DSP56300 core

includes a barrel shifter, 24-bit addressing, an

instruction cache, and direct memory access

(DMA). The DSP56309 offers 100 MIPS at

3.0–3.6 V using an internal 100 MHz clock.

The large on-chip memory is ideal for

wireless infrastructure and wireless local-loop

applications. The DSP56300 core family

offers a new level of performance in speed

and power provided by its rich instruction set

and low-power dissipation, thus enabling a

new generation of wireless, multimedia, and

telecommunications products.

Note: This document contains information on a new product. Specifications and information herein are subject to change without notice.

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