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DSP56002FC40 PDF预览

DSP56002FC40

更新时间： 2024-01-15 12:22:21
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 外围集成电路数字信号处理器装置时钟
页数 文件大小 规格书
110页 662K
描述
24-BIT DIGITAL SIGNAL PROCESSOR

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DSP56002FC40 技术参数

生命周期：Transferred零件包装代码：QFP
包装说明：QFP,针数：132
Reach Compliance Code：unknownECCN代码：3A991.A.2
HTS代码：8542.31.00.01风险等级：5.45
Is Samacsys：N地址总线宽度：16
桶式移位器：NO边界扫描：NO
最大时钟频率：40 MHz外部数据总线宽度：24
格式：FIXED POINT内部总线架构：MULTIPLE
JESD-30 代码：S-PQFP-G132长度：24.13 mm
低功率模式：YES端子数量：132
封装主体材料：PLASTIC/EPOXY封装代码：QFP
封装形状：SQUARE封装形式：FLATPACK
认证状态：Not Qualified座面最大高度：4.572 mm
最大供电电压：5.5 V最小供电电压：4.5 V
标称供电电压：5 V表面贴装：YES
技术：HCMOS端子形式：GULL WING
端子节距：0.635 mm端子位置：QUAD
宽度：24.13 mmuPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHER
Base Number Matches：1

DSP56002FC40 数据手册

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DSP56002/D, Rev. 3  
SEMICONDUCTOR TECHNICAL DATA  
DSP56002  
24-BIT DIGITAL SIGNAL PROCESSOR  
The DSP56002 is a MPU-style general purpose Digital Signal Processor (DSP) composed of an  
efficient 24-bit DSP core, program and data memories, various peripherals, and support  
circuitry. The DSP56000 core is fed by on-chip Program RAM, and two independent data RAMs.  
The DSP56002 contains a Serial Communication Interface (SCI), Synchronous Serial Interface (SSI),  
parallel Host Interface (HI), Timer/ Event Counter, Phase Lock Loop (PLL), and an On-Chip  
Emulation (OnCE™) port. This combination of features, illustrated in Figure 1, makes the  
DSP56002 a cost-effective, high-performance solution for high-precision general purpose digital  
signal processing.  
16-bit Bus  
24-bit Bus  
1
6
3
15  
Program  
Memory  
512 × 24 RAM  
64 × 24 ROM  
(boot)  
X Data  
Memory  
256 × 24 RAM  
256 × 24 ROM  
(A-law/ µ-law)  
24-bit  
Timer/  
Event  
Sync.  
Serial  
Comm.  
(SCI)  
Host  
Interface  
(HI)  
Y Data  
Memory  
256 × 24 RAM  
256 × 24 ROM  
(sine)  
Serial  
(SSI)  
or I/O  
Counter  
or I/O  
or I/O  
External  
Address  
Bus  
PAB  
Address  
16  
Address  
Generation  
Unit  
24-bit  
56000 DSP  
Core  
XAB  
YAB  
Switch  
GDB  
PDB  
XDB  
YDB  
External  
Data  
Bus  
Internal  
Data  
Bus  
Data  
24  
Switch  
Switch  
OnCE™  
Port  
Control  
10  
Bus  
Control  
Program  
Program  
Address  
Data ALU  
24 × 24 + 56 → 56-bit MAC  
Two 56-bit Accumulators  
Interrupt  
Control  
Decode  
Controller  
Generator  
Clock  
PLL  
Gen.  
Program Control Unit  
7
4
3
IRQ  
AA0604  
Figure 1 DSP56002 Block Diagram  
©1996 MOTOROLA, INC.  
 
1234567...110

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