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Datasheet > 驱动程序和接口 > 线路驱动器或接收器> DS90CF383BMT
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DS90CF383BMT

更新时间： 2024-09-15 04:01:51
品牌 Logo 应用领域
美国国家半导体 - NSC 线路驱动器或接收器显示器驱动程序和接口接口集成电路光电二极管
页数 文件大小 规格书
11页 641K
描述
+3.3V Programmable LVDS Transmitter 24-Bit Flat Panel Display (FPD) Link-65 MHz

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DS90CF383BMT 技术参数

是否Rohs认证： 不符合生命周期：Transferred
包装说明：TSSOP-56Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.08差分输出：YES
驱动器位数：4输入特性：STANDARD
接口集成电路类型：LINE DRIVER接口标准：EIA-644; TIA-644
JESD-30 代码：R-PDSO-G56JESD-609代码：e0
长度：14 mm湿度敏感等级：2
功能数量：1端子数量：56
最高工作温度：70 °C最低工作温度：-10 °C
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP56,.3,20封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：235
电源：3.3 V认证状态：Not Qualified
最大接收延迟：座面最大高度：1.1 mm
子类别：Line Driver or Receivers最大压摆率：60 mA
最大供电电压：3.6 V最小供电电压：3 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：0.5 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：6.1 mm
Base Number Matches：1

DS90CF383BMT 数据手册

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October 2005  
DS90CF383B  
+3.3V Programmable LVDS Transmitter 24-Bit Flat Panel  
Display (FPD) Link-65 MHz  
n "Input Clock Detection" feature will pull all LVDS pairs to  
logic low when input clock is missing and when /PD pin  
General Description  
The DS90CF383B transmitter converts 28 bits of CMOS/TTL  
is logic high.  
data into four LVDS (Low Voltage Differential Signaling) data  
streams. A phase-locked transmit clock is transmitted in  
parallel with the data streams over a fifth LVDS link. Every  
n 18 to 68 MHz shift clock support  
n Best–in–Class Set & Hold Times on TxINPUTs  
<
@
n Tx power consumption 130 mW (typ) 65MHz  
Grayscale  
cycle of the transmit clock 28 bits of input data are sampled  
and transmitted. At a transmit clock frequency of 65 MHz, 24  
bits of RGB data and 3 bits of LCD timing and control data  
(FPLINE, FPFRAME, DRDY) are transmitted at a rate of 455  
Mbps per LVDS data channel. Using a 65 MHz clock, the  
data throughput is 227 Mbytes/sec. The DS90CF383B is  
fixed as a Falling edge strobe transmitter and will interoper-  
ate with a Falling edge strobe Receiver (DS90CF386) with-  
out any translation logic.  
n 40% Less Power Dissipation than BiCMOS Alternatives  
<
n Tx Power-down mode 60µW (typ)  
n Supports VGA, SVGA, XGA and Dual Pixel SXGA.  
n Narrow bus reduces cable size and cost  
n Up to 1.8 Gbps throughput  
n Up to 227 Megabytes/sec bandwidth  
n 345 mV (typ) swing LVDS devices for low EMI  
n PLL requires no external components  
n Compatible with TIA/EIA-644 LVDS standard  
n Low profile 56-lead TSSOP package  
n Improved replacement for:  
This chipset is an ideal means to solve EMI and cable size  
problems associated with wide, high speed TTL interfaces.  
Features  
n No special start-up sequence required between  
clock/data and /PD pins. Input signal (clock and data)  
can be applied either before or after the device is  
powered.  
SN75LVDS83, DS90CF383A  
n Support Spread Spectrum Clocking up to 100KHz  
frequency modulation & deviations of 2.5% center  
spread or −5% down spread.  
Block Diagram  
DS90CF383B  
20098501  
Order Number DS90CF383BMT  
See NS Package Number MTD56  
TRI-STATE® is a registered trademark of National Semiconductor Corporation.  
© 2006 National Semiconductor Corporation  
DS200985  
www.national.com  
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DS90CF383BMT 替代型号

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