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Datasheet > 驱动程序和接口 > 线路驱动器或接收器> DS90CF366MTD/NOPB
DS90CF366MTD/NOPB PDF预览

DS90CF366MTD/NOPB

更新时间： 2024-09-15 13:07:27
品牌 Logo 应用领域
德州仪器 - TI 时钟
页数 文件大小 规格书
20页 1154K
描述
+3.3V LVDS Receiver 18-Bit Flat Panel Display (FPD) Link - 85 MHz 48-TSSOP -10 to 70

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DS90CF366MTD/NOPB 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：TSSOP
包装说明：TSSOP, TSSOP48,.3,20针数：48
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：6 weeks
风险等级：1.07差分输出：NO
输入特性：DIFFERENTIAL接口集成电路类型：LINE RECEIVER
接口标准：EIA-644; TIA-644JESD-30 代码：R-PDSO-G48
JESD-609代码：e3长度：12.5 mm
湿度敏感等级：2功能数量：4
端子数量：48最高工作温度：70 °C
最低工作温度：-10 °C输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP48,.3,20封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
电源：3.3 V认证状态：Not Qualified
最大接收延迟：接收器位数：3
座面最大高度：1.1 mm子类别：Line Driver or Receivers
最大压摆率：105 mA最大供电电压：3.6 V
最小供电电压：3 V标称供电电压：3.3 V
电源电压1-最大：3.6 V电源电压1-分钟：3 V
电源电压1-Nom：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：0.5 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：6.1 mm
Base Number Matches：1

DS90CF366MTD/NOPB 数据手册

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DS90CF366, DS90CF386  
www.ti.com  
SNLS055I –NOVEMBER 1999–REVISED APRIL 2013  
DS90CF386/DS90CF366 +3.3V LVDS Receiver 24-Bit Flat Panel Display (FPD) Link - 85  
MHz, +3.3V LVDS Receiver 18-Bit Flat Panel Display (FPD) Link - 85 MHz  
Check for Samples: DS90CF366, DS90CF386  
1
FEATURES  
DESCRIPTION  
The DS90CF386 receiver converts the four LVDS  
data streams (Up to 2.38 Gbps throughput or 297.5  
Megabytes/sec bandwidth) back into parallel 28 bits  
of CMOS/TTL data (24 bits of RGB and 4 bits of  
Hsync, Vsync, DE and CNTL). Also available is the  
DS90CF366 that converts the three LVDS data  
streams (Up to 1.78 Gbps throughput or 223  
Megabytes/sec bandwidth) back into parallel 21 bits  
of CMOS/TTL data (18 bits of RGB and 3 bits of  
Hsync, Vsync and DE). Both Receivers' outputs are  
Falling edge strobe. A Rising edge or Falling edge  
strobe transmitter (DS90C385/DS90C365) will  
interoperate with a Falling edge strobe Receiver  
without any translation logic.  
•
•
20 to 85 MHz Shift Clock Support  
Rx Power Consumption <142 mW (typ)  
@85MHz Grayscale  
•
•
•
Rx Power-Down Mode <1.44 mW (max)  
ESD Rating >7 kV (HBM), >700V (EIAJ)  
Supports VGA, SVGA, XGA and Single Pixel  
SXGA.  
•
•
•
PLL Requires No External Components  
Compatible with TIA/EIA-644 LVDS Standard  
Low Profile 56-Lead or 48-lead TSSOP  
Package  
•
DS90CF386 Also Available in a 64 Ball, 0.8mm  
Fine Pitch Ball Grid Array (NFBGA) Package  
The DS90CF386 is also offered in a 64 ball, 0.8mm  
fine pitch ball grid array (NFBGA) package which  
provides a 44 % reduction in PCB footprint compared  
to the 56L TSSOP package.  
This chipset is an ideal means to solve EMI and  
cable size problems associated with wide, high speed  
TTL interfaces.  
BLOCK DIAGRAM  
Figure 1. DS90CF386  
Figure 2. DS90CF366  
See Package Number DGG-48 (TSSOP)  
See Package Number DGG-56 (TSSOP) or  
NZC0064A-64 (NFBGA)  
1
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of the Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
Copyright © 1999–2013, Texas Instruments Incorporated  
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DS90CF366MTD/NOPB 替代型号

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