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DS90C3202VS

更新时间： 2024-02-27 07:15:17

品牌	Logo	应用领域
美国国家半导体 - NSC		光电二极管
页数	文件大小	规格书
22页	1581K
描述
3.3V 8 MHz to 135 MHz Dual FPD-Link Receiver

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DS90C3202VS 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	包装说明：	TFQFP, TQFP128,.63SQ,16
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	Factory Lead Time：	1 week
风险等级：	0.81	接口集成电路类型：	BUFFER OR INVERTER BASED PERIPHERAL DRIVER
JESD-30 代码：	S-PQFP-G128	JESD-609代码：	e3
长度：	14 mm	湿度敏感等级：	3
端子数量：	128	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	TFQFP	封装等效代码：	TQFP128,.63SQ,16
封装形状：	SQUARE	封装形式：	FLATPACK, THIN PROFILE, FINE PITCH
峰值回流温度（摄氏度）：	260	电源：	3.3 V
认证状态：	Not Qualified	座面最大高度：	1.2 mm
子类别：	Line Driver or Receivers	最大压摆率：	550 mA
标称供电电压：	3.3 V	表面贴装：	YES
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn)
端子形式：	GULL WING	端子节距：	0.4 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	14 mm	Base Number Matches：	1

DS90C3202VS 数据手册

September 2006

DS90C3202

3.3V 8 MHz to 135 MHz Dual FPD-Link Receiver

General Description

Features

n Up to 9.45 Gbit/s data throughput

n 8 MHz to 135 MHz input clock support

n Supports up to QXGA panel resolutions

The DS90C3202 is a 3.3V single/dual FPD-Link 10-bit color

receiver is designed to be used in Liquid Crystal Display

TVs, LCD Monitors, Digital TVs, and Plasma Display Panel

TVs. The DS90C3202 is designed to interface between the

digital video processor and the display device using the

low-power, low-EMI LVDS (Low Voltage Differential Signal-

ing) interface. The DS90C3202 converts up to ten LVDS

data streams back into 70 bits of parallel LVCMOS/LVTTL

data. The receiver can be programmed with rising edge or

falling edge clock. Optional wo-wire serial programming al-

lows fine tuning in development and production environ-

ments. With an input clock at 135 MHz, the maximum trans-

mission rate of each LVDS line is 945 Mbps, for an

aggregate throughput rate of 9.45 Gbps (945 Mbytes/s). This

allows the dual 10-bit LVDS Receiver to support resolutions

up to HDTV.

n Supports HDTV panel resolutions and frame rates up to

1920 x 1080p

n LVDS 30-bit, 24-bit or 18-bit color data inputs

n Supports single pixel and dual pixel interfaces

n Supports spread spectrum clocking

n Two-wire serial communication interface

n Programmable clock edge and control strobe select

n Power down mode

n +3.3V supply voltage

n 128-pin TQFP Package

n Compliant to TIA/EIA-644-A-2001 LVDS Standard

Block Diagram

20147101

FIGURE 1. Receiver Block Diagram

DS201471

www.national.com

12 3 4 5 6 7...22

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型号	品牌	获取价格	描述	数据表
DS90C3202VS/NOPB	TI	获取价格	3.3V 8MHz 至 135MHz 双路 FPD 链接接收器 \| PDT \| 128 \|
DS90C363	NSC	获取价格	+3.3V Programmable LVDS Transmitter 18-Bit Fl
DS90C363_13	TI	获取价格	3.3V Programmable LVDS Transmitter 18-Bit Fla
DS90C363A	NSC	获取价格	+3.3V Programmable LVDS Transmitter 18-Bit Flat Panel Display (FPD) Link-65 MHz, +3.3V LVD
DS90C363AMTD	NSC	获取价格	+3.3V Programmable LVDS Transmitter 18-Bit Flat Panel Display (FPD) Link-65 MHz, +3.3V LVD
DS90C363AMTDX	TI	获取价格	QUAD LINE DRIVER, PDSO48, LOW PROFILE, PLASTIC, TSSOP-48
DS90C363AMTDX	NSC	获取价格	IC QUAD LINE DRIVER, PDSO48, LOW PROFILE, PLASTIC, TSSOP-48, Line Driver or Receiver
DS90C363AMTDX	ROCHESTER	获取价格	QUAD LINE DRIVER, PDSO48, LOW PROFILE, PLASTIC, TSSOP-48
DS90C363B	NSC	获取价格	+3.3V Programmable LVDS Transmitter 18-Bit Flat Panel Display (FPD) Link -65 MHz
DS90C363B	TI	获取价格	+3.3V 可编程 LVDS 发送器 18 位平板显示器 (FPD) 链路 - 65MHz

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