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Datasheet > 驱动程序和接口 > 线路驱动器或接收器> DS90C124IVS
DS90C124IVS PDF预览

DS90C124IVS

更新时间： 2024-09-25 03:01:47
品牌 Logo 应用领域
美国国家半导体 - NSC 线路驱动器或接收器驱动程序和接口接口集成电路
页数 文件大小 规格书
26页 1040K
描述
5-35MHz DC-Balanced 24-Bit LVDS Serializer and Deserializer

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DS90C124IVS 技术参数

是否Rohs认证： 不符合生命周期：Transferred
包装说明：7 X 7 MM, 1 MM HEIGHT, 0.50 MM PITCH, TQFP-48Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.28Is Samacsys：N
差分输出：NO输入特性：DIFFERENTIAL
接口集成电路类型：LINE RECEIVER接口标准：GENERAL PURPOSE
JESD-30 代码：S-PQFP-G48JESD-609代码：e0
长度：7 mm湿度敏感等级：1
功能数量：1端子数量：48
最高工作温度：105 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TFQFP
封装等效代码：TQFP48,.35SQ封装形状：SQUARE
封装形式：FLATPACK, THIN PROFILE, FINE PITCH峰值回流温度（摄氏度）：260
电源：3.3 V认证状态：Not Qualified
最大接收延迟：接收器位数：1
座面最大高度：1.2 mm子类别：Line Driver or Receivers
最大压摆率：75 mA最大供电电压：3.6 V
最小供电电压：3 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn85Pb15)
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：7 mmBase Number Matches：1

DS90C124IVS 数据手册

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January 8, 2008  
DS90C241/DS90C124  
5-35MHz DC-Balanced 24-Bit LVDS Serializer and  
Deserializer  
General Description  
The DS90C241/DS90C124 Chipset translates a 24-bit paral-  
lel bus into a fully transparent data/control LVDS serial stream  
with embedded clock information. This single serial stream  
simplifies transferring a 24-bit bus over PCB traces and cable  
by eliminating the skew problems between parallel data and  
clock paths. It saves system cost by narrowing data paths that  
in turn reduce PCB layers, cable width, and connector size  
and pins.  
User selectable clock edge for parallel data on both  
Transmitter and Receiver  
Internal DC Balancing encode/decode – Supports AC-  
coupling interface with no external coding required  
Individual power-down controls for both Transmitter and  
Receiver  
Embedded clock CDR (clock and data recovery) on  
Receiver and no external source of reference clock  
needed  
All codes RDL (random data lock) to support live-  
pluggable applications  
■
■
■
■
■
The DS90C241/DS90C124 incorporates LVDS signaling on  
the high-speed I/O. LVDS provides a low power and low noise  
environment for reliably transferring data over a serial trans-  
mission path. By optimizing the serializer output edge rate for  
the operating frequency range EMI is further reduced.  
LOCK output flag to ensure data integrity at Receiver side  
■
■
Balanced TSETUP/THOLD between RCLK and RDATA on  
Receiver side  
PTO (progressive turn-on) LVCMOS outputs to reduce  
EMI and minimize SSO effects  
All LVCMOS inputs and control pins have internal  
pulldown  
■
■
In addition the device features pre-emphasis to boost signals  
over longer distances using lossy cables. Internal DC bal-  
anced encoding/decoding is used to support AC-Coupled  
interconnects.  
On-chip filters for PLLs on Transmitter and Receiver  
Temperature range –40°C to +105°C  
Greater than 8 kV HBM ESD tolerant  
Meets AEC-Q100 compliance  
■
■
■
■
■
■
Features  
5 MHz–35 MHz clock embedded and DC-Balancing 24:1  
■
and 1:24 data transmissions  
User defined Pre-Emphasis driving ability through external  
resistor on LVDS outputs and capable to drive up to 10  
meters shielded twisted-pair cable  
Power supply range 3.3V ± 10%  
48-pin TQFP package  
■
Block Diagram  
20171901  
TRI-STATE® is a registered trademark of National Semiconductor Corporation.  
© 2008 National Semiconductor Corporation  
201719  
www.national.com  
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DS90C124IVS 替代型号

型号 品牌 替代类型 描述 数据表
DS90C124IVSX NSC

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