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Datasheet > 逻辑 > 移位寄存器> DM74LS164N
DM74LS164N PDF预览

DM74LS164N

更新时间： 2024-11-26 23:00:43
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 移位寄存器触发器逻辑集成电路光电二极管
页数 文件大小 规格书
5页 64K
描述
8-Bit Serial In/Parallel Out Shift Register

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DM74LS164N 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：0.300 INCH, PLASTIC, MS-001, DIP-14
针数：14Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.13
Is Samacsys：N计数方向：RIGHT
系列：LSJESD-30 代码：R-PDIP-T14
JESD-609代码：e0长度：19.18 mm
逻辑集成电路类型：SERIAL IN PARALLEL OUT最大频率@ Nom-Sup：25000000 Hz
位数：8功能数量：1
端子数量：14最高工作温度：70 °C
最低工作温度：输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP14,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：5 V传播延迟（tpd）：40 ns
认证状态：Not Qualified座面最大高度：5.08 mm
子类别：Shift Registers最大供电电压 (Vsup)：5.25 V
最小供电电压 (Vsup)：4.75 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：TTL
温度等级：COMMERCIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：7.62 mm
最小 fmax：25 MHzBase Number Matches：1

DM74LS164N 数据手册

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August 1986  
Revised April 2000  
DM74LS164  
8-Bit Serial In/Parallel Out Shift Register  
General Description  
Features  
■ Gated (enable/disable) serial inputs  
■ Fully buffered clock and serial inputs  
■ Asynchronous clear  
These 8-bit shift registers feature gated serial inputs and  
an asynchronous clear. A low logic level at either input  
inhibits entry of the new data, and resets the first flip-flop to  
the low level at the next clock pulse, thus providing com-  
plete control over incoming data. A high logic level on  
either input enables the other input, which will then deter-  
mine the state of the first flip-flop. Data at the serial inputs  
may be changed while the clock is HIGH or LOW, but only  
information meeting the setup and hold time requirements  
will be entered. Clocking occurs on the LOW-to-HIGH level  
transition of the clock input. All inputs are diode-clamped to  
minimize transmission-line effects.  
■ Typical clock frequency 36 MHz  
■ Typical power dissipation 80 mW  
Ordering Code:  
Order Number Package Number  
Package Description  
DM74LS164M  
DM74LS164N  
M14A  
N14A  
14-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-120, 0.150 Narrow  
14-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide  
Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.  
Connection Diagram  
Function Table  
Inputs  
Outputs  
QA  
QB  
QH  
Clear  
Clock  
A
X
X
H
L
B
X
X
H
X
L
...  
...  
...  
...  
...  
...  
L
X
L
↑
↑
↑
L
QA0  
H
L
L
H
H
H
H
QB0  
QAn  
QAn  
QAn  
QH0  
QGn  
QGn  
QGn  
L
X
L
H = HIGH Level (steady state)  
L = LOW Level (steady state)  
X = Don't Care (any input, including transitions)  
↑ = Transition from LOW-to-HIGH level  
Q
, Q , Q = The level of Q , Q , or Q , respectively, before the  
B0 H0 A B H  
A0  
indicated steady-state input conditions were established.  
, Q = The level of Q or Q before the most recent ↑ transition of the  
Q
An  
Gn  
A
G
clock; indicates a one-bit shift.  
© 2000 Fairchild Semiconductor Corporation  
DS006398  
www.fairchildsemi.com  
12345

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