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DM74ALS573BWM PDF预览

DM74ALS573BWM

更新时间： 2024-11-03 22:13:55
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 锁存器逻辑集成电路光电二极管驱动
页数 文件大小 规格书
7页 74K
描述
Extended Temperature Octal D-Type Transparent Latch

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DM74ALS573BWM 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOP, SOP20,.4
针数：20Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：7.43
其他特性：BROADSIDE VERSION OF 373系列：ALS
JESD-30 代码：R-PDSO-G20JESD-609代码：e3
长度：12.8 mm逻辑集成电路类型：BUS DRIVER
最大I（ol）：0.024 A湿度敏感等级：1
位数：8功能数量：1
端口数量：2端子数量：20
最高工作温度：70 °C最低工作温度：
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP20,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
电源：5 V最大电源电流（ICC）：27 mA
Prop。Delay @ Nom-Sup：14 ns传播延迟（tpd）：20 ns
认证状态：Not Qualified座面最大高度：2.65 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：TTL
温度等级：COMMERCIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.5 mm

DM74ALS573BWM 数据手册

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April 1984  
Revised February 2000  
DM74ALS573B  
Extended Temperature Octal D-Type Transparent Latch  
with 3-STATE Outputs  
General Description  
Features  
■ Switching specifications at 50 pF  
These 8-bit registers feature totem-pole 3-STATE outputs  
designed specifically for driving highly-capacitive or rela-  
tively low-impedance loads. The high-impedance state and  
increased high-logic-level drive provide these registers with  
the capability of being connected directly to and driving the  
bus lines in a bus-organized system without need for inter-  
face or pull-up components. They are particularly attractive  
for implementing buffer registers, I/O ports, bidirectional  
bus drivers, and working registers.  
■ Switching specifications guaranteed over full tempera-  
ture and VCC range  
■ Advanced oxide-isolated, ion-implanted Schottky TTL  
process  
■ Functionally equivalent with DM74LS373  
■ Improved AC performance over DM74LS373 at approxi-  
mately half the power  
The eight latches of the DM74ALS573B are transparent D-  
type latches. While the enable (G) is HIGH the Q outputs  
will follow the data (D) inputs. When the enable is taken  
LOW the output will be latched at the level of the data that  
was set UP.  
■ 3-STATE buffer-type outputs drive bus lines directly  
A buffered output control input can be used to place the  
eight outputs in either a normal logic state (HIGH or LOW  
logic levels) or a high-impedance state. In the high-imped-  
ance state the outputs neither load nor drive the bus lines  
significantly.  
The output control does not affect the internal operation of  
the latches. That is, the old data can be retained or new  
data can be entered even while the outputs are OFF.  
Ordering Code:  
Order Number  
DM74ALS573BWM  
DM74ALS573BSJ  
DM74ALS573BN  
Package Number  
M20B  
Package Description  
20-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-013, 0.300 Wide  
20-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide  
20-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide  
M20D  
N20A  
Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.  
Connection Diagram  
© 2000 Fairchild Semiconductor Corporation  
DS006226  
www.fairchildsemi.com  
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DM74ALS573BWM 替代型号

型号 品牌 替代类型 描述 数据表
SN74ALS573CDWR TI

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