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CY8C20666-24LTXIT

更新时间： 2024-09-23 06:51:51

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赛普拉斯 - CYPRESS		/
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CapSense™ Applications

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CY8C20666-24LTXIT 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	QFN	包装说明：	7 X 7 MM, 1 MM HEIGHT, MO-220, QFN-48
针数：	48	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.76
地址总线宽度：		位大小：	8
边界扫描：	NO	总线兼容性：	USB
CPU系列：	M8C	最大时钟频率：	25.2 MHz
外部数据总线宽度：		JESD-30 代码：	S-XQCC-N48
JESD-609代码：	e4	长度：	7 mm
湿度敏感等级：	3	I/O 线路数量：	36
端子数量：	48	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装等效代码：	LCC48,.27SQ,20
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
电源：	1.8/5.5 V	认证状态：	Not Qualified
RAM（字节）：	2048	RAM（字数）：	1024
ROM（单词）：	32768	ROM可编程性：	FLASH
座面最大高度：	1 mm	速度：	24 MHz
子类别：	Microcontrollers	最大压摆率：	4 mA
最大供电电压：	5.5 V	最小供电电压：	1.71 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	7 mm	Base Number Matches：	1

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CY8C20x46, CY8C20x66

CapSense™ Applications

Features

■ Low Power CapSense^TMBlock

■ Programmable Pin Configurations

❐ Configurable Capacitive Sensing Elements

❐ 25 mA Sink Current on All GPIO

^❐T^So^uu^pc^ph^op^ra^tsd^Cs,^oT^mo^buⁱcⁿh^aS^tic^orⁿee^on^fs^C,^aa^pn^Sd^ePⁿr^so^ex^Bim^ui^tt^ty^onS^se^,n^Ss^lo^idrs^ers,

❐ Pull Up, High Z, Open Drain Drive Modes on All GPIO

❐ CMOS Drive Mode on Ports 0 and 1

❐ Up to 36 Analog Inputs on GPIO

■ Powerful Harvard Architecture Processor

❐ M8C Processor Speeds Running to 24 MHz

❐ Low Power at High Speed

❐ Interrupt Controller

❐ 1.71V to 5.5V Operating Voltage

❐ Temperature Range: – 40°C to +85°C

❐ Configurable Inputs on All GPIO

❐ Selectable, Regulated Digital IO on Port 1

❐ Configurable Input Threshold for Port 1

❐ 3.0V, 20 mA Total Port 1 Source Current

❐ 5 mA Source Current Mode on Ports 0 and 1

❐ Hot-Swap Capability on all Port1 GPIO

■ Flexible On-Chip Memory

❐ Two Program Storage Size Options

• CY8C20x46: 16K Flash

■ Versatile Analog Mux

❐ Common Internal Analog Bus

❐ Simultaneous Connection of IO Combinations

❐ High PSRR Comparator

• CY8C20x66: 32K Flash

❐ 50,000 Erase/Write Cycles

❐ 2048 Bytes SRAM Data Storage

❐ Partial Flash Updates

❐ Low Dropout Voltage Regulator for the Analog Array

■ Additional System Resources

❐ Flexible Protection Modes

❐ In-System Serial Programming (ISSP)

❐ I²C™ Slave

• Selectable to 50 kHz, 100 kHz, or 400 kHz

• Implementation Requires No Clock Stretching

■ Full-Speed USB (12 Maps)

• Implementation During Sleep Modes with

❐ Eight Uni-Directional Endpoints

Less Than 100 µA

❐ One Bi-Directional Control Endpoint

❐ USB 2.0 Compliant

• Hardware Address Detection

❐ SPI™ Master and SPI Slave

• Configurable Between 46.9 kHz – 12 MHz

❐ Three 16-Bit Timers

❐ Dedicated 512 Byte Buffer

❐ Internal 3.3V Output Regulator

❐ Available on 48-Pin QFN and 48-Pin SSOP packages only

❐ Operating voltage with USB enabled:

• 3.15 to 3.45V when supply voltage is around 3.3V

• 4.35 to 5.25V when supply voltage is around 5.0V

❐ Watchdog and Sleep Timers

❐ Internal Voltage Reference

❐ Integrated Supervisory Circuit

■ Package Options

■ Complete Development Tools

❐ Free Development Tool (PSoC Designer™)

❐ Full-Featured, In-Circuit Emulator and Programmer

❐ Full Speed Emulation

❐ Complex Breakpoint Structure

❐ 128K Trace Memory

❐ 16-Pin 3x3 x 0.6 mm QFN

❐ 24-Pin 4x4 x 0.6 mm QFN

❐ 32-Pin 5x5 x 0.6 mm QFN

❐ 48-Pin 7x7 x 1.0 mm QFN (CY8C20x66 only)

❐ 48-Pin SSOP

■ Precision, Programmable Clocking

❐ Internal ± 5.0% 6/12/24 MHz Main Oscillator

^❐S^Inl^te^ee^rp^{nal Low Speed Oscillator at 32 kHz for Watchdog and}

❐ Optional External 32 kHz Crystal

❐ 0.25% Accuracy for USB with No External Components

Cypress Semiconductor Corporation

Document Number: 001-12696 Rev. *C

•

198 Champion Court

•

San Jose, CA 95134-1709

•

408-943-2600

Revised October 13, 2008

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