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CY7C1012AV33-8BGC

更新时间： 2024-09-17 22:03:15
品牌 Logo 应用领域
赛普拉斯 - CYPRESS /
页数 文件大小 规格书
9页 178K
描述
512K x 24 Static RAM

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CY7C1012AV33-8BGC 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：BGA
包装说明：14 X 22 MM, 2.40 MM HEIGHT, PLASTIC, BGA-119针数：119
Reach Compliance Code：compliantECCN代码：3A991.B.2.B
HTS代码：8542.32.00.41Factory Lead Time：1 week
风险等级：5.76最长访问时间：8 ns
其他特性：AUTOMATIC POWER-DOWNI/O 类型：COMMON
JESD-30 代码：R-PBGA-B119JESD-609代码：e0
长度：22 mm内存密度：12582912 bit
内存集成电路类型：STANDARD SRAM内存宽度：24
湿度敏感等级：3功能数量：1
端子数量：119字数：524288 words
字数代码：512000工作模式：ASYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：512KX24输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：BGA
封装等效代码：BGA119,7X17,50封装形状：RECTANGULAR
封装形式：GRID ARRAY并行/串行：PARALLEL
峰值回流温度（摄氏度）：220电源：3.3 V
认证状态：Not Qualified座面最大高度：2.4 mm
最大待机电流：0.05 A最小待机电流：3 V
子类别：SRAMs最大压摆率：0.3 mA
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：BALL
端子节距：1.27 mm端子位置：BOTTOM
处于峰值回流温度下的最长时间：20宽度：14 mm

CY7C1012AV33-8BGC 数据手册

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CY7C1012AV33  
512K x 24 Static RAM  
Writing the data bytes into the SRAM is accomplished when  
the chip select controlling that byte is LOW and the write  
enable input (WE) input is LOW. Data on the respective  
input/output (I/O) pins is then written into the location specified  
on the address pins (A0–A18). Asserting all of the chip selects  
LOW and write enable LOW will write all 24 bits of data into  
the SRAM. Output enable (OE) is ignored while in WRITE  
mode.  
Features  
• High speed  
— tAA = 8, 10, 12 ns  
• Low active power  
— 1080 mW (max.)  
• Operating voltages of 3.3 ± 0.3V  
• 2.0V data retention  
• Automatic power-down when deselected  
• TTL-compatible inputs and outputs  
• Easy memory expansion with CE0, CE1 and CE2  
features  
Data bytes can also be individually read from the device.  
Reading a byte is accomplished when the chip select  
controlling that byte is LOW and write enable (WE) HIGH while  
output enable (OE) remains LOW. Under these conditions, the  
contents of the memory location specified on the address pins  
will appear on the specified data input/output (I/O) pins.  
Asserting all the chip selects LOW will read all 24 bits of data  
from the SRAM.  
Functional Description  
The CY7C1012AV33 is a high-performance CMOS static RAM  
organized as 512K words by 24 bits. Each data byte is  
separately controlled by the individual chip selects (CE0, CE1,  
CE2). CE0 controls the data on the I/O0–I/O7, while CE1  
controls the data on I/O8–I/O15, and CE2 controls the data on  
the data pins I/O16–I/O23. This device has an automatic  
power-down feature that significantly reduces power  
consumption when deselected.  
The 24 I/O pins (I/O0–I/O23) are placed in a high-impedance  
state when all the chip selects are HIGH or when the output  
enable (OE) is HIGH during a READ mode. For further details,  
refer to the truth table of this data sheet.  
The CY7C1012AV33 is available in a standard 119-ball BGA.  
Functional Block Diagram  
INPUT BUFFER  
A
0
A
1
A
2
I/O –I/O  
0
7
A
3
4
512K x 24  
ARRAY  
A
I/O –I/O  
8
15  
A
5
6
4096 x 4096  
A
I/O –I/O  
16  
23  
A
7
A
8
A
9
CE , CE , CE  
0
1
2
COLUMN  
DECODER  
WE  
CONTROL LOGIC  
OE  
Selection Guide  
–8  
8
–10  
10  
–12  
12  
Unit  
ns  
Maximum Access Time  
Maximum Operating Current  
Commercial  
300  
300  
50  
275  
275  
50  
260  
260  
50  
mA  
Industrial  
Maximum CMOS Standby Current  
Commercial/Industrial  
mA  
Cypress Semiconductor Corporation  
Document #: 38-05254 Rev. *D  
•
3901 North First Street  
•
San Jose, CA 95134  
•
408-943-2600  
Revised November 12, 2002  
1234567...9

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CY7C1012AV33-8BGC 替代型号

型号 品牌 替代类型 描述 数据表
CY7C1012DV33-10BGXI CYPRESS

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